參數(shù)資料
型號(hào)： EP2S60F484I4N
廠商： Altera
文件頁(yè)數(shù)： 680/768頁(yè)
文件大小： 0K
描述： IC STRATIX II FPGA 60K 484-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 20
系列： Stratix® II
LAB/CLB數(shù)： 3022
邏輯元件/單元數(shù)： 60440
RAM 位總計(jì)： 2544192
輸入/輸出數(shù)： 334
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA（23x23）
配用： 544-1700-ND - DSP KIT W/STRATIX II EP2S60N
544-1697-ND - NIOS II KIT W/STRATIX II EP2S60N
其它名稱： 544-1910
EP2S60F484I4N-ND
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9–18
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
I/O Voltage Support in JTAG Chain
Figure 9–13. JTAG Chain of Mixed Voltages
Table 9–3. Supported TDO/TDI Voltage Combinations
Device
TDI Input Buffer
Power
Stratix II and Stratix II GX TDO VCCIO Voltage Level in I/O Bank 4
VCCIO = 3.3 V
VCCIO = 2.5 V
VCCIO = 1.8 V
VCCIO = 1.5 V
Stratix II and
Stratix II GX
Always VCCPD (3.3V)
v (1)
v (2)
v (3)
level shifter
required
Non-Stratix II
VCC = 3.3 V
v (1)
v (2)
v (3)
level shifter
required
VCC = 2.5 V
v (1), (4)
v (2)
v (3)
level shifter
required
VCC = 1.8 V
v (1), (4)
v
level shifter
required
VCC = 1.5 V
v (1), (4)
v (6)
v
Notes to Table 9–3:
(1)
The TDO output buffer meets VOH (MIN) = 2.4 V.
(2)
The TDO output buffer meets VOH (MIN) = 2.0 V.
(3)
An external 250- pull-up resistor is not required, but recommended if signal levels on the board are not optimal.
(4)
Input buffer must be 3.3-V tolerant.
(5)
Input buffer must be 2.5-V tolerant.
(6)
Input buffer must be 1.8-V tolerant.
3.3 V
VCCIO
Level
Shifter
2.5 V
VCCIO
1.8 V
VCCIO
1.5 V
VCCIO
Tester
TDO
TDI
Must be 3.3 V Tolerant.
Shift TDO to
level accepted
by tester if
necessary.
Must be
1.8 V tolerant.
Must be
2.5 V tolerant.
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EP2S60F672C3 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix II 3022 LABs 492 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F672C3N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix II 3022 LABs 492 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F672C4 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix II 3022 LABs 492 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F672C4N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix II 3022 LABs 492 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S60F672C5 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Stratix II 3022 LABs 492 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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