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參數資料
| 型號： | DZPD6722VCCE |
| 廠商： | INTEL CORP |
| 元件分類： | 總線控制器 |
| 英文描述： | ISA-to-PC-Card (PCMCIA) Controllers |
| 中文描述： | PCMCIA BUS CONTROLLER, PQFP208 |
| 封裝： | LQFP-208 |
| 文件頁數： | 109/138頁 |
| 文件大?。?/td> | 723K |
| 代理商： | DZPD6722VCCE |
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ISA-to-PC-Card (PCMCIA) Controllers
—
PD6710/
’
22
Datasheet
109
16.4.5
PC Card Bus Timing Calculations
Calculations for minimum PC Card cycle Setup, Command, and Recovery timings are made by
first calculating factors derived from the applicable timer set
’
s timing registers and then by
applying the factor to an equation relating it to the internal clock period.
The PC Card cycle timing factors, in terms of the number of internal clocks, are calculated as
follows:
S
= (
N
pres
×
N
val
) + 1
C
= (
N
pres
×
N
val
) + 1
R
= (
N
pres
×
N
val
) + 1
T
CLKP
Input clock period,
internal clock
69.84
–
0.1%
69.84 + 0.1%
ns
Normal synthesizer
operation. Misc Control 2
register, bit 0 =
‘
0
’
. CLK
pin at 14.318 MHz.
T
CLKP
Input clock period,
external clock
40
–
0.1%
40 + 0.1%
ns
Synthesizer bypassed.
Misc Control 2 register,
bit 0 =
‘
1
’
.
CLK pin at 25 MHz.
V
IHmin
CLK input high voltage
2.0
V
CORE_VDD = 3.0 V
V
ILmax
CLK input low voltage
0.8
V
CORE_VDD = 3.6 V
V
IHCmin
CLK input high voltage
0.7 V
DD
V
CORE_VDD = 4.5 V
V
ILCmax
CLK input low voltage
0.2 V
DD
V
CORE_VDD = 5.5 V
Figure 22. Input Clock Specification
Table 30. Input Clock Specification
(Sheet 2 of 2)
Symbol
Parameter
MIN
MAX
Units
Conditions
t
1
V
ILmax
, V
ILCmax
t
2
t
3
t
4
T
CLKP
CLK
V
IHmin
, V
IHCmin
V
center
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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