參數(shù)資料
型號(hào)： DS33R41+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 246/335頁(yè)
文件大?。?/td> 0K
描述： IC TXRX ETHERNET MAP 400-BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
類(lèi)型： 收發(fā)器
驅(qū)動(dòng)器/接收器數(shù)： 4/4
規(guī)程： T1/E1/J1
電源電壓： 3.14 V ~ 3.47 V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 托盤(pán)
產(chǎn)品目錄頁(yè)面： 1429 (CN2011-ZH PDF)
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DS33R41 Inverse-Multiplexing Ethernet Mapper with Quad Integrated T1/E1/J1 Transceivers
32 of 335
Figure 7-1. DS33R41 400-Ball BGA Pinout
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
A
VSS
TSSYNC3
RMSYNC3
RCHBLK3
RPOSO3
TSYSCLK3
N.C.
TCLKT2
TVDD
TRING2
TTIP2
TVSS
TCHBLK2
RSYNC2
WR/RW
D1
A5
A0
A1
B
DVSS
RSYNC3
RCHCLK3
RSERO3
DVDD
N.C.
TSIG2
TSERI2
TVDD
TRING2
TTIP2
TVSS
RCHBLK2
D6
VDD3.3
A3
VDD3.3
C
RCLKO3
TSYNC3
DVSS
RFSYNC3
N.C.
RSYSCLK3
JTDI2
RCLK2
DVDD
TNEGO2
TCHCLK2
RLOS/
LOTC2
D7
A9
A7
A2
VDD3.3
REF_CLK
D
TVSS
TCHBLK3
RLOS/
LOTC3
RSIG3
TPD
RNEGO3
DVDD
RCLKO2
TSYNC2
RCHCLK2
VSS
D5
A8
VDD3.3
E
TTIP3
TCHCLK3
N.C.
RVSS
RTIP3
MODEC[0]
DVDD
TCLKO2
TPOSO2
TSSYNC2
RFSYNC2
INT
D4
A6
A4
VDD3.3
MDC
F
TRING3
TNEGO3
TPOSO3
RVSS
RRING3
RVDD
DVDD
VSS
DVSS
RMSYNC2
VSS
RD/DS
D3
D2
VDD3.3
MDIO
G
TVDD
TVDD
TCLKO3
VSS
RVSS
VSS
BPCLK2
RNEGO2
DVSS
VSS
JTMS1
JTRST1
MODEC[1]
VDD3.3
D0
QOVF
REF_CLKO
VSS
H
RCLK3
TSIG3
DVSS
TSYSCLK1
VSS
RSIG2
RVSS
JTDO1
RST
CS
N.C.
RXD[1]
RXD[3]
VSS
J
DVSS
TSERI3
TCLKT3
DVDD
TSYSCLK2
VSS
RPOSO2
RVSS
RRING2
RTIP2
RVDD
VSS
VDD1.8
JTCLK1
RXD[2]
RXD[0]
VSS
K RSYSCLK1
MCLK1
VSS
RSERO1
VSS
RSERO2
RSYSCLK2
N.C.
RMIIMIIS
TCLKE
TSERO
TBSYNC
JTDI1
RX_DV
RX_CLK
RX_ERR
L
RVSS
TSTRST
BPCLK1
VSS
TCHCLK4
JTDO2
JTMS2
MCLK2
JTRST2
RCLKI
RBSYNC
RSERI
DCEDTES
TX_CLK
TX_EN
TXD[0]
M
RRING1
RVSS
RSIG1
TCHBLK1
VSS
RCHBLK4
RSYNC4
RFSYNC4
TCLKO4
VSS
VDD1.8
SDATA[3]
SDATA[1]
VSS
VDD1.8
TXD[2]
TXD[1]
TXD[3]
N
RTIP1
RVSS
RPOSO1
RNEGO1
DVSS
RCLK4
DVSS
TCLKT4
TNEGO4
TPOSO4
VSS
TSSYNC4
VDD1.8
VSS
RX_CRS/
CRS_DV
COL_DET
P
RVDD
RCHCLK1
RCHBLK1
TNEGO1
DVSS
TSYNC4
TSIG4
DVSS
JTCLK2
RCLKO4
TCHBLK4
VSS
SDMASK[1]
SRAS
SDA[11]
VDD1.8
SDMASK[2] SDATA[18] SDATA[19]
R
RFSYNC1
RLOS/
LOTC1
TPOSO1
TCLKO1
DVSS
TSERI4
RVDD
RRING4
RVSS
VSS
SDATA[12]
SDATA[6]
SCAS
SDCS
SBA[0]
SDA[10]
SDATA[31]
VSS
VDD1.8
T
TTIP1
TVSS
DVSS
RSERO4
RVSS
RTIP4
RVSS
SDATA[13] SDATA[14]
SDATA[5]
VDD1.8
SWE
SDA[8]
SDA[0]
SDATA[16] SDATA[27] SDATA[26]
U
TTIP1
TVSS
N.C.
TCLKT1
DVSS
RPOSO4
RSIG4
DVSS
SDATA[15]
SDATA[4]
VSS
SDCLKO
VSS
SDA[1]
SDA[4]
SDATA[29] SDATA[25] SDATA[24]
V
TRING1
TVDD
N.C.
RCLKO1
TSIG1
RNEGO4
RCHCLK4
RLOS/
LOTC4
RMSYNC4
DVSS
SDATA[11] SDATA[10]
SDATA[8]
VSS
SDA[9]
SDA[7]
SDMASK[3] SDATA[30] SDATA[22]
VDD1.8
W
TRING1
TVDD
TSYNC1
TSSYNC1
RCLK1
CST
TVSS
TTIP4
TRING4
TVDD
SDATA[0]
SDATA[9]
SDATA[7]
VDD1.8
SBA[1]
SDA[5]
SDA[3]
SDATA[17] SDATA[20] SDATA[23]
Y RMSYNC1
RSYNC1
TCHCLK1
TSERI1
TSYSCLK4 RSYSCLK4
TVSS
TTIP4
TRING4
TVDD
SDATA[2]
VSS
SDMASK[0] SYSCLKI
VDD1.8
SDA[6]
SDA[2]
VDD1.8
SDATA[28] SDATA[21]
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PDF描述
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