參數資料
型號： DS21552LN
英文描述： 3.3V DS21352 and 5V DS21552 T1 Single-Chip Transceivers
中文描述： 3.3 DS21352及5V DS21552 T1單芯片收發(fā)器
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代理商： DS21552LN
DS21352/DS21552
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Figure 21-9 TRANSMIT SIDE ESF TIMING
Notes:
1.
TSYNC in frame mode (TCR2.3 = 0) and double-wide frame sync is not enabled (TCR2.4 = 0)
2.
TSYNC in frame mode (TCR2.3 = 0) and double-wide frame sync is enabled (TCR2.4 = 1)
3.
TSYNC in multiframe mode (TCR2.3 = 1)
4.
TLINK data (FDL bits) sampled during the F-bit time of odd frame and inserted into the outgoing T1 stream if enabled via
TCR1.2
5.
ZBTSI mode is enabled (TCR2.5 = 1)
6.
TLINK data (Z bits) sampled during the F-bit time of frames 1, 5, 9, 13, 17, and 21 and inserted into the outgoing stream
if enabled via TCR1.2
7.
TLINK and TLCLK are not synchronous with TSSYNC
1
2
3
4
5
6
7
8
9 10 11 12
1
2
3
6
TSSYNC
FRAME#
TLCLK
TSYNC
TSYNC
TSYNC
TLINK
13 14 15 16 17 18 19 20 21 22 23 24 1
2
3
4
5
4
TLCLK
TLINK
5
相關PDF資料
PDF描述
DS21354 MTTF is frequently used interchangeably with MTBF
DS21354L 3.3V/5V E1 Single-Chip Transceivers
DS21354LN 3.3V/5V E1 Single-Chip Transceivers
DS21354 3.3V/5V E1 Single-Chip Transceivers
DS2152LN Enhanced T1 Single-Chip Transceiver
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參數描述
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