參數(shù)資料
型號(hào)： CDCE913_1
廠商： Texas Instruments, Inc.
英文描述： Programmable 1-PLL VCXO Clock Synthesizer With 1.8-V, 2.5-V, and 3.3-V Outputs
中文描述： 可編程1 - PLL頻率石英振蕩器時(shí)鐘合成器的1.8 V，2.5 V和3.3 V輸出
文件頁(yè)數(shù)： 12/23頁(yè)
文件大?。?/td> 428K
代理商： CDCE913_1
www.ti.com
Byte Write Programming Sequence
1
S
7
1
1
A
8
1
A
1
A
1
P
Slave Address
Wr
Data Byte
CommandCode
8
Byte Read Programming Sequence
1
S
7
1
1
A
1
A
1
S
1
1
A
Slave Address
Wr
Rd
8
1
A
1
P
Data Byte
CommandCode
8
7
Slave Address
Block Write Programming Sequence
(1)
1
S
7
1
1
A
1
A
1
A
Slave Address
Wr
8
1
A
1
A
1
A
1
P
Data Byte 0
8
Data Byte N-1
…
8
Data Byte 1
8
CommandCode
Byte Count = N
8
Block Read Programming Sequence
1
S
7
1
1
A
1
A
1
Sr
1
1
A
Slave Address
Wr
Rd
8
1
A
1
A
1
A
1
P
Byte Count N
Data Byte 0
…
Data Byte N-1
8
CommandCode
7
Slave Address
8
8
Timing Diagram for the SDA/SCL Serial Control Interface
P
S
P
SCL
SDA
VIH
VIL
VIH
VIL
A
Bit 7 (MSB)
t
w(SCLH)
Bit 6
Bit 0 (LSB)
t
w(SCLL)
t
r
t
f
t
su(START)
t
h(START)
t
su(SDA)
t
h(SDA)
t
(BUS)
t
r
t
f
t
su(STOP)
CDCE913
CDCEL913
SCAS849A–JUNE 2007–REVISED AUGUST 2007
Figure 8. Byte Write Protocol
Figure 9. Byte Read Protocol
(1)
Data byte 0 bits [7:0] is reserved for Revision Code and Vendor Identification. Also, it is used for internal test purpose
and should not be overwritten.
Figure 10. Block Write Protocol
Figure 11. Block Read Protocol
Figure 12. Timing Diagram for SDA/SCL Serial Control Interface
12
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Copyright 2007, Texas Instruments Incorporated
Product Folder Link(s):
CDCE913 CDCEL913
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