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參數(shù)資料
| 型號(hào)： | AT89C51RB2-SLSUM |
| 廠商： | Atmel |
| 文件頁數(shù)： | 35/127頁 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU FLASH 16K 44PLCC |
| 產(chǎn)品培訓(xùn)模塊： | MCU Product Line Introduction |
| 標(biāo)準(zhǔn)包裝： | 972 |
| 系列： | 89C |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 60MHz |
| 連通性： | SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲(chǔ)器容量： | 16KB（16K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 1.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-LCC（J 形引線） |
| 包裝： | 管件 |
| 配用： | AT89OCD-01-ND - USB EMULATOR FOR AT8XC51 MCU AT89STK-11-ND - KIT STARTER FOR AT89C51RX2 |
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AT89C51RB2/RC2
4180E–8051–10/06
Functional Block
Diagram
Figure 4. Functional Oscillator Block Diagram
Prescaler Divider
A hardware RESET puts the prescaler divider in the following state:
CKRL = FFh: FCLK CPU = FCLK PERIPH = FOSC/2 (Standard C51 feature)
Any value between FFh down to 00h can be written by software into CKRL register
in order to divide frequency of the selected oscillator:
CKRL = 00h: minimum frequency
F
CLK CPU = FCLK PERIPH = FOSC/1020 (Standard Mode)
F
CLK CPU = FCLK PERIPH = FOSC/510 (X2 Mode)
CKRL = FFh: maximum frequency
FCLK CPU = FCLK PERIPH = FOSC/2 (Standard Mode)
FCLK CPU = FCLK PERIPH = FOSC (X2 Mode)
FCLK CPU and FCLK PERIPH
In X2 Mode, for CKRL<>0xFF:
In X1 Mode, for CKRL<>0xFF then:
Xtal2
Xtal1
Osc
CLK
Idle
CPU clock
CKRL
Reload
8-bit
Prescaler-Divider
Reset
Peripheral Clock
:2
X2
0
1
F
OSC
CKCON0
CLK
PERIPH
CPU
CKRL = 0xFF?
0
1
F
CPU
F
=
CLKPER IPH
F
OSC
2
255
CKRL
–
()
×
-----------------------------------------------
=
F
CPU
F
=
CLKPER IPH
F
OSC
4
255
CKRL
–
()
×
-----------------------------------------------
=
相關(guān)PDF資料 |
PDF描述 |
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