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參數(shù)資料
| 型號： | AN1218 |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | HC05 to HC08 Optimization |
| 中文描述： | 以HC08的優(yōu)化HC05 |
| 文件頁數(shù)： | 53/56頁 |
| 文件大小： | 417K |
| 代理商： | AN1218 |
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Application Note
Appendix J — Five Miscellaneous CPU08 Instructions Including BCD, Divide, and CCR Operations
AN1218 Rev. 2
53
* HC08 code *
NSA ;3,1 swap the nibbles of A
* Total CPU05 cycles, bytes = 26,9
* Total CPU08 cycles, bytes = 3,1
***** DIV - divide 16 bit by 8 bit
*
The immediate addressing mode is used to load the registers
* to illustrate the components needed to execute
* a DIV instruction.
LDHX #$0200 ; H
←
$02
LDX #$80 ; X
←
$80
LDA #$00 ; A
←
$00
DIV ; H:A / X = A rem H
; Answer is $04 rem 0
***** TAP - transfer accumulator to ccr
* A is predefined at $E2
* CCR = %0110,0000
TAP ; CCR
←
(A)
; CCR = %1110,0010
***** TPA - transfer ccr to accumulator
* A is predefined at $00
* CCR = %1110,0010
TPA ; A
←
(CCR)
; A = $E2
DONE NOP
BRA DONE
***** Initialize the reset vector
ORG $FFFE
DW START
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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