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參數(shù)資料
| 型號(hào)： | ALC202 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | 圓形連接器 |
| 英文描述： | Circular Connector; No. of Contacts:100; Series:MS27484; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:22; Circular Contact Gender:Pin; Circular Shell Style:Straight Plug; Insert Arrangement:22-35 RoHS Compliant: No |
| 中文描述： | AC\u0026#39;97音頻編解碼器 |
| 文件頁數(shù)： | 23/29頁 |
| 文件大小： | 598K |
| 代理商： | ALC202 |
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Preliminary
Avance Logic, Inc.
ALC202
-
23 -
Rev0.62
http://www.realtek.com.tw
6.1.3 S/PDIFoutput Characteristics:
Dvdd= 3.3V, T
ambient
=25
0
C, with 75 ohm external load.
Parameter
High level output voltage
Low level output voltage
Symbol
V
OH
V
OL
Min
3.0
-
Typ
3.3
0
Max
Units
V
V
0.5
6.2 AC Timing Characteristics
6.2.1 Cold Reset:
Parameter
RESET# active low pulse width T
rst_low
RESET# inactive to BIT_CLK
Startup delay
Symbol
Min
1.0
162.8
Typ
-
-
Max
-
-
Units
us
ns
T
rst2clk
Fig 6.2.1-1 Cold reset timing diagram
6.2.2 Warm Reset:
Fig 6.2.2-1 Cold reset timing diagram
Parameter
Symbol
SYNC active high pulse width
SYNC inactive to BIT_CLK
Startup delay
Min
1.0
162.8
Typ
-
-
Max
-
-
Units
us
ns
T
sync_high
T
sync2clk
6.2.3 AC-Link Clocks:
Fig 6.2.3-1 BIT_CLK and SYNC timing diagram
Parameter
Symbol
Min
-
-
-
36
36
-
Typ
12.288
81.4
-
40.7
40.7
48.0
Max
-
-
750
45
45
-
Units
MHz
ns
ps
ns
ns
KHz
BIT_CLK frequency
BIT_CLK period
BIT_CLK output jitter
BIT_CLK high pulse width (note 2) T
clk_high
BIT_CLK low pulse width (note 2)
SYNC frequency
T
clk_period
T
clk_low
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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