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參數(shù)資料
| 型號： | AK4633 |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 元件分類： | Codec |
| 英文描述： | 16-Bit Mono CODEC with ALC & MIC/SPK-AMP |
| 中文描述： | 16位單聲道編解碼器ALC的 |
| 文件頁數(shù)： | 78/82頁 |
| 文件大小： | 688K |
| 代理商： | AK4633 |
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ASAHI KASEI
[AK4633]
MS0447-E-03
2006/04
- 78 -
Stop of Clock
Master clock can be stopped when ADC, DAC and programmable filter don’t operate.
1. PLL Master Mode
External MCKI
PMPLL bit
(Addr:01H, D0)
MCKO bit
(Addr:01H, D1)
Input
(3)
(1)
(2)
"H" or "L"
Example:
Audio I/F Format: DSP Mode, BCKP = MSBS = “0”
BICK frequency at Master Mode : 64fs
Input Master Clock Select at PLL Mode : 11.2896MHz
Sampling Frequency:8kHz
Stop an external MCKI
(1) (2) Addr:01H, Data:08H
Figure 57. Clock Stopping Sequence (1)
<Example>
(1) Power down PLL: PMPLL bit =
“
1
”
→
“
0
”
(2) Stop MCKO clock: MCKO bit =
“
1
”
→
“
0
”
(3) Stop an external master clock.
2. PLL Slave Mode (FCK or BICK pins)
External BICK
PMPLL bit
(Addr:01H, D0)
Input
(1)
(2)
External FCK
Input
(2)
Example
Audio I/F Format : DSP Mode, BCKP = MSBS = “0”
PLL Reference clock: BICK
BICK frequency: 64fs
Sampling Frequency: 8kHz
(1) Addr:01H, Data:04H
(2) Stop the external clocks
Figure 58. Clock Stopping Sequence (2)
<Example>
(1) Power down PLL: PMPLL bit =
“
1
”
→
“
0
”
(2) Stop the external BICK and FCK clocks.
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PDF描述 |
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