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參數(shù)資料
| 型號(hào)： | AK4538VN |
| 廠(chǎng)商： | Asahi Kasei Microsystems Co.,Ltd |
| 元件分類(lèi)： | Codec |
| 英文描述： | 16Bit DS CODEC with MIC/HP/SPK-AMP |
| 中文描述： | 16位副編解碼器麥克風(fēng)/惠普/胰腎聯(lián)合移植腺苷 |
| 文件頁(yè)數(shù)： | 62/70頁(yè) |
| 文件大小： | 485K |
| 代理商： | AK4538VN |
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ASAHI KASEI
[AK4538]
MS0198-E-01
2003/5
- 62 -
3. When an external clock is used in PLL mode. (Slave mode)
MCKPD bit
(Addr:01H, D7)
PS1-0 bits
(Addr:04H, D5-4)
PMPLL bit
(Addr:01H, D5)
MCKO bit
(Addr:04H, D3)
MCKO pin
XX
00
(1)
Output
BICK, LRCK
(Slave Mode)
Input
External MCLK
Input
(2)
(3)
40ms(max)
(4)
(5)
(6)
(7)
Example :
Audio I/F Format : I
2
S
BICK frequency at Master Mode : 64fs
Input M aster C lock Select at PLL Mode : 11.2896MHz
(1) Addr:01H, Data:00H
(2) Input external MCLK
(3) Addr:01H, Data 20H
(5) MCKO output starts
(6) BICK and LRCK input start
(7) Addr:04H, Data 6AH
(4) Addr:04H, Data 4AH
Figure 50. Clock Set Up Sequence(3)
<Example>
(1) Release the pull-down of the XTI pin : MCKPD bit = “1”
→
“0”
(2) Input an external MCLK
(3) Power-up PLL : PMPLL bit = “0”
→
“1”
PLL needs 40ms lock time after the PMPLL bit = “0”
→
“1”.
(4) Enable MCKO output : MCKO bit = “0”
→
“1”
(5) MCKO is output after PLL lock time.
(6) Input BICK and LRCK that synchronized in the MCKO output.
(7) Set up MCKO output frequency (PS1-0 bits)
If PS1-0 bits are changed before LRCK is input, MCKO is not output. PS1-0 bits should be changed after
LRCK is input.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AK4541VQ | AC’97 Rev 2.1 Multimedia Audio CODEC |
| AK4541 | AC’97 Rev 2.1 Multimedia Audio CODEC |
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| AK4544A | AC97 MULTIMEDIA AUDIO CODEC WITH SRC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AK4541 | 制造商:AKM 制造商全稱(chēng):AKM 功能描述:AC’97 Rev 2.1 Multimedia Audio CODEC |
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