參數(shù)資料
型號(hào)： ADV3205JSTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 18/21頁(yè)
文件大?。?/td> 0K
描述： IC CROSSPOINT SWIT 16X16 100LQFP
標(biāo)準(zhǔn)包裝： 1
功能： 交叉點(diǎn)開(kāi)關(guān)
電路： 1 x 16:16
電壓電源： 單/雙電源
電壓 - 電源，單路/雙路(±)： 4.5 V ~ 5.5 V，±5.5 V
電流 - 電源： 45mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤(pán)
Data Sheet
ADV3205
Rev. 0 | Page 5 of 20
TIMING CHARACTERISTICS (PARALLEL MODE)
Table 4.
Limit
Parameter
Symbol
Min
Max
Unit
Parallel Data Setup Time
t1d
20
ns
Address Setup Time
t1a
20
ns
CLK Enable Width
t2
100
ns
Parallel Data Hold Time
t3d
20
ns
Address Hold Time
t3a
20
ns
CLK Pulse Separation
t4
100
ns
CLK-to-UPDATE Delay
t5
0
ns
UPDATE Pulse Width
t6
50
ns
Propagation Delay, UPDATE to Switch On or Off
50
ns
CLK, UPDATE Rise and Fall Times
100
ns
RESET Time
200
ns
103
42
-003
1
0
CLK
1
0
A0 TO A3
1
0
D0 TO D4
1 = LATCHED
UPDATE
0 = TRANSPARENT
t6
t5
t1a
t3a
t3d
t1d
t4
t2
Figure 3. Timing Diagram, Parallel Mode
Table 5. Logic Levels
VIH
VIL
VOH
VOL
IIH
IIL
IOH
IOL
RESET, SER/PAR
CLK, D0, D1, D2,
D3, D4, A0, A1, A2,
A3, CE, UPDATE
RESET, SER/PAR
CLK, D0, D1, D2,
D3, D4, A0, A1, A2,
A3, CE, UPDATE
DATA OUT
RESET, SER/PAR
CLK, D0, D1, D2,
D3, D4, A0, A1, A2,
A3, CE, UPDATE
RESET, SER/PAR
CLK, D0, D1, D2,
D3, D4, A0, A1, A2,
A3, CE, UPDATE
DATA OUT
2.0 V min
0.8 V max
2.7 V min
0.5 V max
20 μA max
400 μA min
400 μA max
3.0 mA min
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