參數(shù)資料
型號(hào)： ADSP-BF542KBCZ-6A
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號(hào)處理
英文描述： 600 MHz Blackfin Embedded Processor: ADSP-BF542KBCZ-6A Temp Range: 0°C to +70°C Package: 400-Ball CSP_BGA BC-400-1
中文描述： 16-BIT, 50 MHz, OTHER DSP, PBGA400
封裝： 17 X 17 MM, ROHS COMPLIANT, CSBGA-400
文件頁數(shù)： 82/100頁
文件大?。?/td> 3095K
代理商： ADSP-BF542KBCZ-6A
Rev. D
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May 2011
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
ATAPI Ultra DMA Data-Out Transfer Timing
Table 61 and Figure 57 through Figure 60 describes the ATAPI
ultra DMA data-out transfer timing. The material in these fig-
ures is adapted from ATAPI-6 (INCITS 361-2002[R2007] and is
used with permission of the American National Standards Insti-
tute (ANSI) on behalf of the Information Technology Industry
Council (“ITIC”). Copies of ATAPI-6 (INCITS 361-2002
[R2007] can be purchased from ANSI.
Table 61. ATAPI Ultra DMA Data-Out Transfer Timing
ATAPI Parameter
ATAPI_ULTRA_TIM_x Timing
Register Setting
1
Timing Equation
tCYC
2
Cycle time
TDVS, TCYC_TDVS
(TDVS + TCYC_TDVS) × tSCLK
t2CYC
Two cycle time
TDVS, TCYC_TDVS
2 × (TDVS + TCYC_TDVS) × tSCLK
tDVS
Data valid setup time at sender
TDVS
TDVS × tSCLK – (tSK1 + tSK2)
tDVH
Data valid hold time at sender
TCYC_TDVS
TCYC_TDVS × tSCLK – (tSK1 + tSK2)
tCVS
CRC word valid setup time at host
TDVS
TDVS × tSCLK – (tSK1 + tSK2)
tCVH
CRC word valid hold time at host
TACK
TACK × tSCLK – (tSK1 + tSK2)
tDZFS
Time from data output released-to-driving to first
strobe timing
TDVS
TDVS × tSCLK – (tSK1 + tSK2)
tLI
Limited interlock time
N/A
2 × tBD + 2 × tSCLK + tOD
tMLI
Interlock time with minimum
TMLI
TMLI × tSCLK – (tSK1 + tSK2)
tENV
3
ATAPI_DMACK to ATAPI_DIOR/DIOW
TENV
(TENV × tSCLK) +/– (tSK1 + tSK2)
tRFS
Ready to final strobe time
N/A
2 × tBD + 2 × tSCLK + tOD
tACK
Setup and Hold time for ATAPI_DMACK
TACK
TACK × tSCLK – (tSK1 + tSK2)
tSS
Time from STROBE edge to assertion of ATAPI_DIOW TSS
TSS × tSCLK – (tSK1 + tSK2)
1 ATAPI Timing Register Setting should be programmed with a value that guarantees parameter compliance with the ATA ANSI specification for ATA device mode of operation.
2 ATA/ATAPI-6 compliant functionality with limited speed.
3 This timing equation can be used to calculate both the minimum and maximum t
ENV.
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PDF描述
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ADSP-BF547BBCZ-5A 533 MHz Blackfin Embedded Processor: ADSP-BF547BBCZ-5A Temp Range: –40°C to +85°C Package: 400-Ball CSP_BGA BC-400-1
ADSP-BF547MBBCZ-5M 533 MHz Blackfin Embedded Processor: ADSP-BF547MBBCZ-5M Temp Range: –40°C to +85°C Package: 400-Ball CSP_BGA BC-400-1
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參數(shù)描述
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