參數(shù)資料
型號: ADSP-21160M
廠商: Analog Devices, Inc.
元件分類: 數(shù)字信號處理
英文描述: DSP Microcomputer
中文描述: DSP微機(jī)
文件頁數(shù): 43/53頁
文件大小: 696K
代理商: ADSP-21160M
43
REV. 0
ADSP-21160M
The load capacitance should include the processor
s
package capacitance (C
IN
). The switching frequency
includes driving the load high and then back low. Address
and data pins can drive high and low at a maximum rate of
1/(2t
CK
). The write strobe can switch every cycle at a
frequency of 1/t
CK
. Select pins switch at 1/(2t
CK
), but selects
can switch on each cycle.
Table 29. ADSP-21160M Operation Types vs. Input Current
Operation
Instruction Type
Instruction Fetch
Core Memory Access
2
Peak Activity
1
Multifunction
Cache
2 per t
CK
cycle
(DM 64 and PM 64)
1 per 2 t
CCLK
cycles
1 per external port cycle ( 64)
Worst case
High Activity
1
Multifunction
Internal Memory
1 per t
CK
cycle
(DM 64)
1 per 2 t
CCLK
cycles
1 per external port cycle ( 64)
Random
Low Activity
1
Single Function
Internal Memory
None
Internal Memory DMA
External Memory DMA
Data bit pattern for core
memory access and DMA
None
None
N/A
1
Peak Activity=I
DDINPEAK
, High Activity=I
DDINHIGH
, and Low Activity=I
DDINLOW
. The state of the PEYEN bit (SIMD versus SISD mode) does not influence
these calculations.
2
These assume a 2:1 core clock ratio. For more information on ratios and clocks (t
CK
and t
CCLK
), see the timing ratio definitions
on page 15
.
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PDF描述
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