參數(shù)資料
型號(hào)： ADSP-21065LCCA-240
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號(hào)處理
英文描述： DSP Microcomputer
中文描述： 32-BIT, 33.33 MHz, OTHER DSP, PBGA196
封裝： CHIP SCALE, MS-034AAE-1, BGA-196
文件頁數(shù)： 35/44頁
文件大?。?/td> 416K
代理商： ADSP-21065LCCA-240
REV. C
ADSP-21065L
–35–
JTAG Test Access Port and Emulation
Parameter
Min
Max
Unit
Timing Requirements:
t
TCK
t
STAP
t
HTAP
t
SSYS
t
HSYS
t
TRSTW
TCK Period
TDI, TMS Setup Before TCK High
TDI, TMS Hold After TCK High
System Inputs Setup Before TCK Low
1
System Inputs Hold After TCK Low
1
TRST
Pulsewidth
t
CK
3.0
3.0
7.0
12.0
4 t
CK
ns
ns
ns
ns
ns
ns
Switching Characteristics:
t
DTDO
t
DSYS
TDO Delay from TCK Low
System Outputs Delay After TCK Low
2
11.0
15.0
ns
ns
NOTES
1
System Inputs = DATA
31-0
, ADDR
23-0
,
RD
,
WR
, ACK,
SBTS
,
SW
,
HBR
,
HBG
,
CS
,
DMAR
1
,
DMAR
2
,
BR
2-1
, ID
1-0
,
IRQ
2-0
, FLAG
11-0
, DR0x, DR1x, TCLK0,
TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, BSEL,
BMS
, CLKIN,
RESET
, SDCLK
0
,
RAS
,
CAS
,
SDWE
, SDCKE, PWM_EVENTx.
2
System Outputs = DATA
31-0
, ADDR
23-0
, MS
3-0
,
RD
,
WR
, ACK,
SW
,
HBG
, REDY, DMAG1
,
DMAG2,
BR
2-1
,
CPA
, FLAG
11-0
, PWM_EVENTx, DT0x, DT1x,
TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1,
BMS
, SDCLK0, SDCLK1, DQM, SDA10,
RAS
,
CAS
,
SDWE
, SDCKE, BM, XTAL.
TCK
t
STAP
t
TCK
t
HTAP
t
DTDO
t
SSYS
t
HSYS
t
DSYS
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
Figure 23. JTAG Test Access Port and Emulation
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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