參數(shù)資料
型號(hào)： ADMC401BSTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 52/60頁(yè)
文件大小： 0K
描述： IC DSP 8CH 12BIT MOTCTRL 144LQFP
標(biāo)準(zhǔn)包裝： 1
系列： 電機(jī)控制
類型： 定點(diǎn)
接口： 串行端口
時(shí)鐘速率： 26MHz
非易失內(nèi)存： ROM（6 kB）
芯片上RAM： 8kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
REV. B
ADMC401
–56–
DM (0x3FFC)
TPERIOD (R/W)
TCOUNT (R/W)
TSCALE (R/W)
DM (0x3FFD)
DM (0x3FFB)
15
14
13
12
11
10
9876543210
0
00
SSTAT (R)
PC STACK EMPTY
PC STACK OVERFLOW
COUNT STACK EMPTY
COUNT STACK OVERFLOW
STATUS STACK EMPTY
STATUS STACK OVERFLOW
LOOP STACK EMPTY
LOOP STACK OVERFLOW
76
543
2
1
0
1
0
1
0
1
0
1
0
MSTAT (R/W)
6543210
0
DSP REGISTER
DATA REGISTER BANK SELECT
0 = PRIMARY, 1 = SECONDARY
BIT REVERSE MODE ENABLE (DAG1)
ALU OVERFLOW LATCH MODE ENABLE
AR SATURATION MODE ENABLE
MAC RESU PLACEMENT
0 = FRACTIONAL,LT 1 = INTERGER
TIMER ENABLE
GO MODE ENABLE
SYSCNTL (R/W)
PWAIT
PROGRAM MEMORY
WAIT STATES
15
14
13
12
11
10
9876543210
BPAGE
BOOT PAGE SELECT
BWAIT
BOOT WAIT STATES
BFORCE
BOOT FORCE BIT
SPORT0 ENABLE
1 = ENABLE, 0 = DISABLED
1
0
1
0
1
11
1
0
DM (0x3FFF)
SPORT1 ENABLE
1 = ENABLE, 0 = DISABLED
SPORT1 CONFIGURE
1 = SERIAL PORT
0 = FI, FO, IRQ0, IRQ1, SCLK
AZ ALU RESULT ZERO
AN ALU RESULT NEGATIVE
AV ALU OVERFLOW
AC ALU CARRY
AS ALU X INPUT SIGN
AQ ALU QUOTIENT
MV MAC OVERFLOW
SS SHIFTER INPUT SIGN
76
5
4
321
0
ASTAT (R/W)
0
DSP REGISTER
Figure 44 Structure of Registers of ADMC401
Default bit values are shown; if no value is shown, the bit field is undefined at reset. Reserved bits are shown on a gray field—these
bits should always be written as shown.
相關(guān)PDF資料
PDF描述
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