CK is defined as 0.5tCKI.
參數(shù)資料
型號(hào)： ADMC401BSTZ
廠商： Analog Devices Inc
文件頁數(shù)： 45/60頁
文件大?。?/td> 0K
描述： IC DSP 8CH 12BIT MOTCTRL 144LQFP
標(biāo)準(zhǔn)包裝： 1
系列： 電機(jī)控制
類型： 定點(diǎn)
接口： 串行端口
時(shí)鐘速率： 26MHz
非易失內(nèi)存： ROM（6 kB）
芯片上RAM： 8kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
ADMC401
–5–
REV. B
Parameter
Min
Max
Unit
Clock Signals
t
CK is defined as 0.5tCKI. The ADMC401 uses an input clock
with a frequency equal to half the instruction rate; a 13 MHz
clock (which is equivalent to 76.9 ns) yields a 38.5 ns processor
cycle (equivalent to 26 MHz). t
CK values within the range of
0.5t
CKI period should be substituted for all relevant timing
parameters to obtain specification value.
Example: t
CKH = 0.5tCK – 10 ns = 0.5 (38.5 ns) – 10 ns = 9.25 ns.
Timing Requirements:
t
CKI
CLKIN Period
76.9
150
ns
t
CKIL
CLKIN Width Low
20
ns
t
CKIH
CLKIN Width High
20
ns
Switching Characteristics:
t
CKL
CLKOUT Width Low
0.5t
CK – 10
ns
t
CKH
CLKOUT Width High
0.5t
CK – 10
ns
t
CKOH
CLKIN High to CLKOUT High
0
20
ns
Control Signals
Timing Requirement:
t
RSP
RESET Width Low
5t
CK
1
ns
PWM Shutdown Signals
Timing Requirements:
tPWMTPW
PWMTRIP Width Low
tCK
ns
tPIOPWM
PIO Width Low
2tCK
ns
ADC Signals
Timing Requirements:
tCSI
Internal Convert Start Width High
2tCK
ns
tCSE
External Convert Start Width High
2tCK
ns
NOTE
1Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator start-up time).
CLKIN
CLKOUT
tCKOH
tCKI
tCKIH
tCKIL
tCKH
tCKL
Figure 1. Clock Signals
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PDF描述
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