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參數(shù)資料
| 型號(hào)： | AD9849AKSTZRL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 19/32頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD SIGNAL PROC 12BIT 48LQFP |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 類型： | CCD 信號(hào)處理器，12 位 |
| 輸入類型： | 邏輯 |
| 輸出類型： | 邏輯 |
| 接口： | 3 線串口 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-LQFP |
| 供應(yīng)商設(shè)備封裝： | 48-LQFP（7x7） |
| 包裝： | 帶卷 (TR) |
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REV. A
AD9848/AD9849
–26–
20
0
12
0
1
VD
NOTES
1. VD FALLING EDGE WILL RESET THE PxGA GAIN REGISTER STEERING TO “012012” LINE.
2. HD FALLING EDGES WILL ALTERNATE THE PxGA GAIN REGISTER STEERING BETWEEN “012012” AND “210210” LINES.
3. FLD STATUS IS IGNORED.
HD
10
2
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
22
0
12
0
1
10
2
0
2
0
Figure 16e. Three-Color Mode II
02
0
13
3
1
VD
NOTES
1. EACH LINE FOLLOWS “01230123” STEERING PATTERN.
2. VD AND HD FALLING EDGES WILL RESET THE PxGA GAIN REGISTER STEERING TO GAIN REGISTER “0.”
3. FLD STATUS IS IGNORED.
HD
13
2
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
20
2
0
13
3
1
13
2
0
2
0
Figure 16f. Four-Color Mode
20
0
31
3
1
VD
NOTES
1. VD FALLING EDGE WILL RESET THE PxGA GAIN REGISTER STEERING TO “01230123” LINE.
2. HD FALLING EDGES WILL ALTERNATE THE PxGA GAIN REGISTER STEERING BETWEEN “01230123” AND “23012301” LINES.
3. FLD STATUS IS IGNORED.
HD
13
2
X
PxGA GAIN
REGISTER
FLD
0
ODD FIELD
EVEN FIELD
22
0
31
3
1
13
2
0
2
0
Figure 16g. Four-Color Mode II
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PDF描述 |
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