參數(shù)資料
型號(hào)： AD9547/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 80/104頁
文件大?。?/td> 0K
描述： BOARD EVALUATION FOR AD9547
設(shè)計(jì)資源： AD9547 Schematic
AD9574 BOM
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： AD9547
主要屬性： 2 個(gè)差分式或 4 個(gè)單端輸入
次要屬性： CMOS，LVPECL 和 LVDS 兼容
已供物品： 板
Data Sheet
AD9547
Rev. E | Page 77 of 104
Register0x0408 to Register0x0417—DistributionChannelDividers
Table 72. Q0 Divider1
Address
Bit
Bit Name
Description
0x0408
[7:0]
Q0
Q0 divider, Bits[7:0].
0x0409
[7:0]
Q0 divider, Bits[15:8].
0x040A
[7:0]
Q0 divider, Bits[23:16].
0x040B
[7:6]
Unused
Unused.
[5:0]
Q0
Q0 divider, Bits[29:24].
1
The default value is 0 (or divide by 1).
Table 73. Q1 Divider1
Address
Bit
Bit Name
Description
0x040C
[7:0]
Q1
Q1 divider, Bits[7:0].
0x040D
[7:0]
Q1 divider, Bits[15:8].
0x040E
[7:0]
Q1 divider, Bits[23:16].
0x040F
[7:6]
Unused
Unused.
[5:0]
Q1
Q1 divider, Bits[29:24].
1
The default value is 0 (or divide by 1).
Table 74. Reserved
Address
Bit
Bit Name
Description
0x0410to
0x0417
[7:0]
Unused
Unused.
REFERENCE INPUT CONFIGURATION (REGISTER 0x0500 TO REGISTER 0x0507)
When all bits are set, the reference receiver section enters a deep sleep mode.
Table 75. Reference Power-Down
Address
Bit
Bit Name
Description
0x0500
[7:4]
Unused
Write a 1 to these bits.
3
Ref BB power-down
REF BB input receiver power-down.
0 (default) = normal operation.
1 = power-down.
2
Ref B power-down
REF B input receiver power-down.
0 (default) = normal operation.
1 = power-down.
1
RefAA power-down
REF AA input receiver power-down.
0 (default) = normal operation.
1 = power-down.
0
Ref A power-down
REF A input receiver power-down.
0 (default) = normal operation.
1 = power-down.
相關(guān)PDF資料
PDF描述
UPA1E331MPD1TD CAP ALUM 330UF 25V 20% RADIAL
LB2518T331M INDUCTOR WOUND 330UH 30MA 1007
VI-J0T-EZ-S CONVERTER MOD DC/DC 6.5V 25W
AD9540/PCBZ BOARD EVAL CLK GEN SYNTH 48LFCSP
HCM15DSEH-S243 CONN EDGECARD 30POS .156 EYELET
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參數(shù)描述
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