參數(shù)資料
型號： AD9523-1/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 58/60頁
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描述： BOARD EVAL FOR AD9523-1
設計資源： AD9523(-1) Eval Board Schematic
AD9523(-1) BOM
AD9523(-1) Gerber Files
標準包裝： 1
主要目的： 計時，時鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： AD9523
主要屬性： 板載 PLL 環(huán)路濾波器
次要屬性： LED 狀態(tài)指示器
已供物品： 板
AD9523-1
Rev. B | Page 7 of 60
PLL1 OUTPUT CHARACTERISTICS
Table 7.
Parameter1
Min
Typ
Max
Unit
Test Conditions/Comments
MAXIMUM OUTPUT FREQUENCY
250
MHz
Rise Time/Fall Time (20% to 80%)
387
665
ps
15 pF load
Duty Cycle
45
50
55
%
f = 250 MHz
OUTPUT VOLTAGE HIGH
Output driver static
VDD3_PLL 0.25
V
Load current = 10 mA
VDD3_PLL 0.1
V
Load current = 1 mA
OUTPUT VOLTAGE LOW
Output driver static
0.2
V
Load current = 10 mA
0.1
V
Load current = 1 mA
1 CMOS driver strength: strong (see Table 52).
OUT0, OUT0 TO OUT13, OUT13 DISTRIBUTION OUTPUT CHARACTERISTICS
Duty cycle performance is specified with the invert divider bit set to 1, and the divider phase bits set to 0.5. (For example, for Channel 0,
0x190[7] = 1 and 0x192[7:2] = 1.)
Table 8.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVPECL MODE
Maximum Output Frequency
1
GHz
Minimum VCO/maximum dividers
Rise Time/Fall Time (20% to 80%)
117
147
ps
100 Ω termination across output pair
Duty Cycle
47
50
52
%
f < 500 MHz
43
48
52
%
f = 500 MHz to 800 MHz
40
49
54
%
f = 800 MHz to 1 GHz
Differential Output Voltage Swing
643
775
924
mV
Magnitude of voltage across pins; output
driver static
Common-Mode Output Voltage
VDD – 1.5
VDD 1.4
VDD 1.25
V
Output driver static
SCALED HSTL MODE, 16 mA
Maximum Output Frequency
1
GHz
Minimum VCO/maximum dividers
Rise Time/Fall Time (20% to 80%)
112
141
ps
100 Ω termination across output pair
Duty Cycle
47
50
52
%
f < 500 MHz
44
48
51
%
f = 500 MHz to 800 MHz
40
49
54
%
f = 800 MHz to 1 GHz
Differential Output Voltage Swing
1.3
1.6
1.7
mV
Nominal supply
Supply Sensitivity
0.6
mV/
mV
Change in output swing vs.
VDD3_OUT[x:y] (ΔVOD/ΔVDD3)
Common-Mode Output Voltage
VDD 1.76
VDD 1.6
VDD 1.42
V
LVDS MODE, 3.5 mA
Maximum Output Frequency
1
GHz
Rise Time/Fall Time (20% to 80%)
138
161
ps
100 Ω termination across output pair
Duty Cycle
48
51
53
%
f < 500 MHz
43
49
53
%
f = 500 MHz to 800 MHz
41
49
55
%
f = 800 MHz to 1 GHz
Differential Output Voltage Swing
Balanced
247
454
mV
Voltage swing between output pins;
output driver static
Unbalanced
50
mV
Absolute difference between voltage
swing of normal pin and inverted pin
Common-Mode Output Voltage
1.125
1.375
V
Output driver static
Common-Mode Difference
50
mV
Voltage difference between output pins;
output driver static
Short-Circuit Output Current
3.5
24
mA
Output driver static
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PDF描述
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AD9512/PCBZ BOARD EVAL FOR AD9512
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