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參數(shù)資料
| 型號： | AD9510BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 48/56頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK DIST 8OUT PLL 64LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 扇出緩沖器（分配），除法器 |
| PLL： | 是 |
| 輸入： | 時鐘 |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:8 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 1.2GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 64-LFCSP-VQ（9x9） |
| 包裝： | 托盤 |
| 配用： | AD9510-VCO/PCBZ-ND - BOARD EVALUATION FOR AD9510 AD9510/PCBZ-ND - BOARD EVALUATION FOR AD9510 |
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AD9510
Data Sheet
Rev. B | Page 52 of 56
Reg.
Addr.
(Hex) Bit(s) Name
Description
[6]
Nosync
Ignore chip-level sync signal (default = 0b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
[7]
Bypass divider
Bypass and power down divider logic; route clock directly to output (default = 0b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
58
[0]
SYNC detect enable 1 = enable SYNC detect (default = 0b).
58
[1]
SYNC select
1 = raise flag if slow clocks are out-of-sync by 0.5 to 1 high speed clock cycles.
0 (default) = raise flag if slow clocks are out-of-sync by 1 to 1.5 high speed clock cycles.
58
[2]
Soft SYNC
The Soft SYNC bit works the same as the FUNCTION pin when in SYNCB mode, except that the polarity of
this bit is reversed. That is, a high level forces selected outputs into a known state, and a high > low
transition triggers a sync (default = 0b).
58
[3]
Dist ref
power-down
1 = power down the references for the distribution section (default = 0b).
58
[4]
SYNC power-down 1 = power down the SYNC (default = 0b).
58
[6:5] FUNCTION pin
select
[6]
[5]
Function
0
RESETB (default)
0
1
SYNCB
1
0
Test only, do not use
1
PDB
58
[7]
Not used.
59
[7:0]
Not used.
5A
[0]
Update registers
Writing a 1 to this bit updates all registers and transfers all serial control port register buffer contents to
the control registers on the next rising SCLK edge. This is a self-clearing bit; a 0 does not have to be
written to clear it.
5A
[7:1]
Not used.
End
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
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| AD9511/PCB | 制造商:Analog Devices 功能描述:1.2 GHZ CLOCK DISTRIBUTION IC, PLL CORE,DIVIDERS, DELAY ADJUST, FIVE OUTPUTS 制造商:Analog Devices 功能描述:EVAL BD FOR AD9511 1.2 GHZ CLOCK DISTRIBUTION IC, PLL CORE,D - Bulk |
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