AVDD = 1.8 V, DRVDD = 1.8 V, TMIN =" />
參數(shù)資料
型號： AD9211BCPZ-300
廠商： Analog Devices Inc
文件頁數(shù)： 24/28頁
文件大?。?/td> 0K
描述： IC ADC 10BIT 300MSPS 56LFCSP
標準包裝： 1
位數(shù)： 10
采樣率（每秒）： 300M
數(shù)據(jù)接口： 串行，SPI?
轉換器數(shù)目： 1
功率耗散（最大）： 468mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 56-VFQFN 裸露焊盤，CSP
供應商設備封裝： 56-LFCSP-VQ（8x8）
包裝： 托盤
輸入數(shù)目和類型： 2 個單端，單極；1 個差分，單極
配用： AD9211-200EBZ-ND - BOARD EVAL FOR AD9211-200
AD9211
Rev. 0 | Page 5 of 28
DIGITAL SPECIFICATIONS
AVDD = 1.8 V, DRVDD = 1.8 V, TMIN = 40°C, TMAX = +85°C, fIN = 1.0 dBFS, full scale = 1.25 V, DCS enabled, unless otherwise noted.
Table 3.
AD9211-200
AD9211-250
AD9211-300
Parameter1
Temp
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Unit
CLOCK INPUTS
Logic Compliance
Full
CMOS/LVDS/LVPECL
Internal Common-Mode Bias
Full
1.2
V
Differential Input Voltage
Full
0.2
6
0.2
6
0.2
6
V p-p
Input Voltage Range
Full
AVDD
0.3
AVDD +
1.6
AVDD
0.3
AVDD +
1.6
AVDD
0.3
AVDD +
1.6
V
Input Common-Mode Range
Full
1.1
AVDD
1.1
AVDD
1.1
AVDD
V
High Level Input Voltage (VIH)
Full
1.2
3.6
1.2
3.6
1.2
3.6
V
Low Level Input Voltage (VIL)
Full
0
0.8
0
0.8
0
0.8
V
High Level Input Current (IIH)
Full
10
+10
10
+10
10
+10
μA
Low Level Input Current (IIL)
Full
10
+10
10
+10
10
+10
μA
Input Resistance (Differential)
Full
16
20
24
16
20
24
16
20
24
kΩ
Input Capacitance
Full
4
pF
LOGIC INPUTS
Logic 1 Voltage
Full
0.8 ×
VDD
0.8 ×
VDD
0.8 ×
VDD
V
Logic 0 Voltage
Full
0.2 ×
AVDD
0.2 ×
AVDD
0.2 ×
AVDD
V
Logic 1 Input Current (SDIO)
Full
0
μA
Logic 0 Input Current (SDIO)
Full
60
μA
Logic 1 Input Current
(SCLK, PWDN, CSB, RESET)
Full
55
50
μA
Logic 0 Input Current
(SCLK, PWDN, CSB, RESET)
Full
0
μA
Input Capacitance
25°C
4
pF
LOGIC OUTPUTS2
VOD Differential Output Voltage
Full
247
454
247
454
247
454
mV
VOS Output Offset Voltage
Full
1.125
1.375
1.125
1.375
1.125
1.375
V
Output Coding
Twos complement, Gray code, or offset binary (default)
1 See the AN-835
application note, Understanding High Speed ADC Testing and Evaluation, for a complete set of definitions and how these tests were completed.
2 LVDS RTERMINATION = 100 Ω.
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PDF描述
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