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參數(shù)資料
型號(hào)： AD9211BCPZ-300
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 17/28頁(yè)
文件大?。?/td> 0K
描述： IC ADC 10BIT 300MSPS 56LFCSP
標(biāo)準(zhǔn)包裝： 1
位數(shù)： 10
采樣率（每秒）： 300M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 468mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 56-VFQFN 裸露焊盤(pán)，CSP
供應(yīng)商設(shè)備封裝： 56-LFCSP-VQ（8x8）
包裝： 托盤(pán)
輸入數(shù)目和類(lèi)型： 2 個(gè)單端，單極；1 個(gè)差分，單極
配用： AD9211-200EBZ-ND - BOARD EVAL FOR AD9211-200
AD9211
Rev. 0 | Page 24 of 28
Table 11. Serial Timing Definitions
Parameter
Timing (minimum, ns)
Description
tDS
5
Setup time between the data and the rising edge of SCLK
tDH
2
Hold time between the data and the rising edge of SCLK
tCLK
40
Period of the clock
tS
5
Setup time between CSB and SCLK
tH
2
Hold time between CSB and SCLK
tHI
16
Minimum period that SCLK should be in a logic high state
tLO
16
Minimum period that SCLK should be in a logic low state
tEN_SDIO
1
Minimum time for the SDIO pin to switch from an input to an output relative to the SCLK
falling edge (not shown in Figure 51)
tDIS_SDIO
5
Minimum time for the SDIO pin to switch from an output to an input relative to the SCLK
rising edge (not shown in Figure 51)
Table 12. Output Data Format
Input (V)
Condition (V)
Offset Binary
Output Mode
D11 to D0
Twos Complement Mode
D11 to D0
Gray Code Mode
(SPI Accessible)
D11 to D0
OR
VIN+ VIN
< 0.62
0000 0000 00
1
VIN+ VIN
= 0.62
0000 0000 00
0
VIN+ VIN
= 0
0000 0000 00
0
VIN+ VIN
= 0.62
1111 1111 11
0000 0000 00
0
VIN+ VIN
> 0.62 + 0.5 LSB
1111 1111 11
0000 0000 00
1
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PDF描述
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