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參數(shù)資料
| 型號(hào)： | A3PN125-2VQ100 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| 封裝： | 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, VQFP-100 |
| 文件頁(yè)數(shù)： | 21/106頁(yè) |
| 文件大?。?/td> | 3324K |
| 代理商： | A3PN125-2VQ100 |
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ProASIC3 nano Flash FPGAs
R e visio n 8
2 -7
Table 2-9 Summary of I/O Output Buffer Power (per pin) – Default I/O Software Settings1
CLOAD (pF)
2
VCCI (V)
Dynamic Power, PAC10 (W/MHz)
3
Single-Ended
3.3 V LVTTL / 3.3 V LVCMOS
10
3.3
162.01
3.3 V LVCMOS wide range4
10
3.3
162.01
2.5 V LVCMOS
10
2.5
91.96
1.8 V LVCMOS
10
1.8
46.95
1.5 V LVCMOS (JESD8-11)
10
1.5
32.22
Notes:
1. Dynamic power consumption is given for standard load and software default drive strength and output
slew.
2. Values for A3PN020, A3PN015, and A3PN010. A3PN060, A3PN125, and A3PN250 correspond to a
default loading of 35 pF.
3. PAC10 is the total dynamic power measured on VCCI.
4. All LVCMOS3.3 V software macros support LVCMOS 3.3 V wide range as specified in the JESD8-B
specification.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A3PN125-2VQG100I | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
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| A3PN125-VQ100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3PN125-VQG100I | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| A3PN125-DIELOT | 制造商:Microsemi Corporation 功能描述:A3PN125-DIELOT - Gel-pak, waffle pack, wafer, diced wafer on film |
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