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參數(shù)資料
| 型號： | μPDPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Micro[rocessor(64位微處理器) |
| 中文描述： | 64位微[rocessor（64位微處理器） |
| 文件頁數(shù)： | 69/97頁 |
| 文件大?。?/td> | 409K |
| 代理商： | ΜPDPD30101 |
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μ
PD30101
68
Data Retention Characteristics (T
A
= –40 to +85 °C)
Parameter
Symbol
Condition
MIN.
MAX.
Unit
Data retention voltage
Note 1
V
DDDR
Hibernate mode
Under evaluation
(2.5)
3.6
V
Data retention high-level input
voltage
Note 2
V
IHDR
Under evaluation
(0.9 V
DDDR
)
V
Notes 1.
The data retention voltage guarantees retention of the data read from the following registers for the
RTC operation, and the data of the compare register (the data in the CPU core cannot be guaranteed).
ETIMELREG, ETIMEMREG, ETIMEHREG, ECOMPLREG, ECOMPMREG, ECOMPHREG, RTCLLREG,
RTCLHREG, RTCLCNTLREG, RTCLCNTHREG
2.
Applied to RTCRST pin
Remark
The values in ( ) are the targeted values.
V
DD
RTCRST
3.0 V
2.5 V
V
DDDR
V
IHDR
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