參數(shù)資料
型號： μPD703033
廠商： NEC Corp.
英文描述： 16/32 Bit Single Chip Microcontrollers(16/32 位單片微控制器)
中文描述： 16/32位單片機微控制器（16/32位單片微控制器）
文件頁數(shù)： 418/427頁
文件大小： 2656K
代理商： ΜPD703033
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APPENDIX B LIST OF INSTRUCTION
418
Instruction Set (alphabetical order) (3/4)
Mnemonic
Operand
Op Code
Operation
Execution
Clock
Flag
i
r
l
CY
OV
S
Z
SAT
SAR
reg1, reg2
rrrrr111111RRRRR
0000000010100000
GR [reg2]
←
GR [reg2] arithmetically shift
right
by GR [reg1]
1
1
1
×
0
×
×
imm5, reg2
rrrrr010101iiiii
GR [reg2]
←
GR [reg2] arithmetically shift
right
by zero-extend (imm5)
1
1
1
×
0
×
×
SATADD
reg1, reg2
rrrrr000110RRRRR
GR [reg2]
←
saturated (GR [reg2]
GR
[reg1])
1
1
1
×
×
×
×
×
imm5, reg2
rrrrr010101iiiii
GR [reg2]
←
saturated (GR [reg2] + sign-
extend (imm5))
1
1
1
×
×
×
×
×
SATSUB
reg1, reg2
rrrrr000101RRRRR
GR [reg2]
←
saturated (GR [reg2]
GR
[reg1])
1
1
1
×
×
×
×
×
SATSUBI
imm16,
reg1, reg2
rrrrr110011RRRRR
iiiiiiiiiiiiiiii
GR [reg2]
←
saturated (GR [reg1]
sign-
extend (imm16))
1
1
1
×
×
×
×
×
SATSUBR reg1, reg2
rrrrr000100RRRRR
GR [reg2]
←
saturated (GR [reg1] + GR
[reg2])
1
1
1
×
×
×
×
×
SETF
cccc, reg2
rrrrr1111110cccc
0000000000000000
if conditions are satisfied
then GR [reg2]
←
00000001H
eise GR [reg2]
←
00000000H
1
1
1
SET1
bit#3,
disp16 [reg1]
00bbb111110RRRRR
dddddddddddddddd
adr
←
GR [reg1] + sign-extend (disp16)
Z flag
←
Not (Load-memory-bit
(adr, bit#3)
Store memory-bit (adr, bit#3, 1)
4
4
4
×
SHL
reg1, reg2
rrrrr111111RRRRR
0000000011000000
GR [reg2]
←
GR [reg2] logically shift left
by GR [reg1])
1
1
1
×
0
×
×
imm5, reg2
rrrrr010110iiiii
GR [reg2]
←
GR [reg2] logically shift left
by zero-extend (imm5)
1
1
1
×
0
×
×
SHR
reg1, reg2
rrrrr1111111cccc
0000000000000000
GR [reg2]
←
GR [reg2] logically shift right
by GR [reg1]
1
1
1
×
0
×
×
imm5, reg2
rrrrr010100iiiii
GR [reg2]
←
GR [reg2] logically shift right
by zero-extend (imm5)
1
1
1
×
0
×
×
SLD.B
disp7 [ep],
reg2
rrrrr0110ddddddd
adr
←
ep + zero-extend (disp7)
GR [reg2]
←
sign-extend (Load-memory
(adr, Byte))
1
1
2
SLD.H
disp8 [ep],
reg2
rrrrr1000ddddddd
Note 1
adr
←
ep + zero-extend (disp7)
GR [reg2]
←
sign-extend (Load-memory
(adr, Byte))
1
1
2
SLD.W
disp8 [ep],
reg2
rrrrr1010ddddddd
Note 2
adr
←
ep + zero-extend (disp7)
GR [reg2]
←
Load-memory (adr, Word)
1
1
2
Notes 1.
ddddddd is the higher 7 bits of dip8.
dddddd is the higher 6 bits of disp8.
2.
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PDF描述
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