參數(shù)資料
型號： μPD42280
廠商： NEC Corp.
英文描述： 2 M-Bit Field Buffer(2M位現(xiàn)場緩存)
中文描述： 2 m位場緩沖器（200萬位現(xiàn)場緩存）
文件頁數(shù)： 9/28頁
文件大小： 200K
代理商： ΜPD42280
9
μ
PD42280
Parameter
Symbol
μ
PD42280-30
μ
PD42280-60
Unit
MIN.
MAX.
MIN.
MAX.
WE High Level Period
t
WEW
0
0
ns
RE High Level Period
t
REW
0
0
ns
OE High Level Period
t
OEW
0
0
ns
WRST Low Level Period (Write Reset Period)
t
WRST
0
0
ns
RRST Low Level Period (Read Reset Period)
t
RRST
0
0
ns
Rise Up, Fall Down Time
t
T
3
35
3
35
ns
Notes
1.
2.
3.
All voltages are determined by referring to the ground level.
Measurement by t
T
= 5 ns.
Input voltage standard levels in the timing specification are V
IH
= 2.4 V and V
IL
= 0.4 V.
Transferring time t
T
is determined between V
IH
= 2.4 V and V
IL
= 0.4 V.
t
LZ
, t
HZ
are measured by
±
200 mV from a stationary state. And t
LZ
is equal to, or more than t
HZ
.
The reference level of input signals is 1.5 V.
When the reset pulse which does not meet t
RS
, t
RH
is input, the reset operation is not assured.
When the reset pulse which does not meet t
RN1
, t
RN2
is input, the reset operation may effect the cycles before
and after.
When WE (RE) pulse which does not meet t
WES
, t
WEH
(or t
RES
, t
REH
) is input, the write (read) disable operation
is not assured.
When WE (RE) pulse which does not meet t
WEN1
, t
WEN2
(or t
REN1
, t
REN2
) is input, the write (read) disable operation
may effect the cycles before and after.
10. When OE pulse which does not meet t
OES
, t
OEH
is input, the output disable operation is not assured.
11. When OE pulse which does not meet t
OEN1
, t
OEN2
is input, the output disable operation may effect the cycles before
and after.
4.
5.
6.
7.
8.
9.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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