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參數(shù)資料
| 型號： | μPD42280 |
| 廠商： | NEC Corp. |
| 英文描述： | 2 M-Bit Field Buffer(2M位現(xiàn)場緩存) |
| 中文描述： | 2 m位場緩沖器（200萬位現(xiàn)場緩存） |
| 文件頁數(shù)： | 18/28頁 |
| 文件大?。?/td> | 200K |
| 代理商： | ΜPD42280 |
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18
μ
PD42280
5.
APPLICATION EXAMPLE
(1) 1 field delay line (the old data read)
With connection as shown in Figure 5-1 by inputting the reset every 1 field cycle (in common with WRST and
RRST), 1 field delay line is realized easily (See Figure 5-2). When the difference between the write address and
the read address is 0 (the read address and the write address are same), the old data is read as shown in Figure
5-2.
Figure 5-1 Circuit of 1 field delay line
4 f
SC
8
8
Reset ( )
WCK
DI0 to
DI7
WE
WRST
RCK
DO0
to DO7
RE
RRST
OE
f : Color subcarrier frequency
SC
Figure 5-2 1 field delay line timing diagram
Field m
Field m + 1
0
1
2
n
0’
1’
2’
3’
t
WCK
(0)
(1)
(2)
(n)
(0’)
(1’)
(2’)
(3’)
t
AC
(0)
(1)
(2)
(3)
2.4 V
2.0 V
0.8 V
Data of the Field m
WCK
RCK
WRST
RRST
DI0 to DI7
DO0 to DO7
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PDF描述 |
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