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參數(shù)資料
| 型號： | Z90T361PZ016SC |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 105/187頁 |
| 文件大?。?/td> | 2235K |
| 代理商： | Z90T361PZ016SC |
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Z90T366 ROM and Z90T361 OTP
eZVision 64 KWord Television Controller with OSD
PS005901-1100
97
4.6
Instruction Timing
The DSP can be executed with single cycle instructions using independent data
memory and program memory buses in the system architecture and pipeline
instructions. This method allows the instruction fetch and execution cycles to
overlap. Figure 27 illustrates the execution sequence. The first instruction takes
two clock cycles to execute; subsequent executions occur in a single cycle. All
instruction fetch cycles have the same machine timing regardless of whether
external or internal memory is used. Because the DSP contains a two-level
pipeline, the
JUMP
and
CALL
instructions do not disrupt the execution process.
In two-word instructions, the second word is fetched while the first word is
executing. Because the processor knows that the instruction is a
JUMP
or
CALL
,
the second word is transferred to the program counter and the correct address is
fetched into the pipeline. There is no disruption or pipeline flushing. The pipeline
flow is affected when the program counter is the destination for a load. Because
the load (
LD
) instruction is a single word instruction, the next instruction is fetched
during load execution. To compensate for the instruction in the pipeline, that
instruction is executed as a
NOP
.
Figure 27
Pipeline Execution
Fetch
the second
instruction
Execute the
first instruction
Execute the
second instruction
Fetch
the first
instruction
相關(guān)PDF資料 |
PDF描述 |
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| Z-9216 | 制造商:ProTek Devices 功能描述: |
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