TABLE
參數(shù)資料
型號(hào)： XRT83L34IVTR-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 72/99頁(yè)
文件大?。?/td> 0K
描述： IC LIU T1/E1/J1 QUAD 128TQFP
標(biāo)準(zhǔn)包裝： 750
類(lèi)型： 線路接口裝置（LIU）
驅(qū)動(dòng)器/接收器數(shù)： 4/4
規(guī)程： T1，E1，J1
電源電壓： 3.135 V ~ 3.465 V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 128-LQFP
供應(yīng)商設(shè)備封裝： 128-TQFP（14x20）
包裝： 帶卷 (TR)
XRT83L34
xr
REV. 1.0.1
QUAD T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
71
TABLE 25: MICROPROCESSOR REGISTER #5, BIT DESCRIPTION
REGISTER ADDRESS
0000101
0010101
0100101
0110101
CHANNEL_n
CHANNEL_0
CHANNEL_1
CHANNEL_2
CHANNEL_3
FUNCTION
REGISTER
TYPE
RESET
VALUE
BIT #
NAME
D7
Reserved
RO
0
D6
DMO_n
Driver Monitor Output: This bit is set to a “1” to indicate
transmit driver failure is detected. The value of this bit is based
on the current status of DMO for the corresponding channel. If
the DMOIE bit is enabled, any transition on this bit will gener-
ate an Interrupt.
RO
0
D5
FLS_n
FiFO Limit Status: This bit is set to a “1” to indicate that the jit-
ter attenuator read/write FIFO pointers are within +/- 3 bits. If
the FLSIE bit is enabled, any transition on this bit will generate
an Interrupt.
RO
0
D4
LCV_n
Line Code Violation: This bit is set to a “1” to indicate that the
receiver of channel n is currently detecting a Line Code Viola-
tion or an excessive number of zeros in the B8ZS or HDB3
modes. If the LCVIE bit is enabled, any transition on this bit will
generate an Interrupt.
RO
0
相關(guān)PDF資料
PDF描述
XRT83L34IVTR IC LIU T1/E1/J1 QUAD 128TQFP
VI-B6H-MX-B1 CONVERTER MOD DC/DC 52V 75W
IDT72V841L15PFI8 IC FIFO SYNC 2048X18 15NS 64QFP
VI-22V-MY CONVERTER MOD DC/DC 5.8V 50W
MS3106R28-15S CONN PLUG 35POS STRAIGHT W/SCKT
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參數(shù)描述
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XRT83L38_07 制造商:EXAR 制造商全稱(chēng):EXAR 功能描述:OCTAL T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
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