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參數(shù)資料
| 型號(hào)： | XR16C864IQ-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 15/51頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART FIFO 128B QUAD 100QFP |
| 標(biāo)準(zhǔn)包裝： | 66 |
| 特點(diǎn)： | * |
| 通道數(shù)： | 4，QUART |
| FIFO's： | 128 字節(jié) |
| 規(guī)程： | RS232，RS485 |
| 電源電壓： | 2.97 V ~ 5.5 V |
| 帶自動(dòng)流量控制功能： | 是 |
| 帶IrDA 編碼器/解碼器： | 是 |
| 帶故障啟動(dòng)位檢測(cè)功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-BQFP |
| 供應(yīng)商設(shè)備封裝： | 100-QFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 1016-1277 |
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XR16C864
22
2.97V TO 5.5V QUAD UART WITH 128-BYTE FIFO
REV. 2.2.0
2.22
Internal Loopback
The 864 UART provides an internal loopback capability for system diagnostic purposes. The internal loopback
mode is enabled by setting MCR register bit-4 to logic 1. All regular UART functions operate normally.
Figure 12 shows how the modem port signals are re-configured. Transmit data from the transmit shift register
output is internally routed to the receive shift register input allowing the system to receive the same data that it
was sending. The TX pin is held at logic 1 or mark condition while RTS# and DTR# are de-asserted, and
CTS#, DSR# CD# and RI# inputs are ignored. Caution: the RX input must be held to a logic 1 during loopback
test else upon exiting the loopback test the UART may detect and report a false “break” signal.
FIGURE 12. INTERNAL LOOP BACK IN CHANNELS A-D
TX A-D
RX A-D
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ls
RTS# A-D
MCR bit-4=1
VCC
Transmit Shift Register
(THR/FIFO)
Receive Shift Register
(RHR/FIFO)
CTS# A-D
DTR# A-D
DSR# A-D
RTS#
CTS#
DTR#
DSR#
VCC
OP1#
RI#
VCC
OP2#
CD#
VCC
OP1# A-D/RS485
RI# A-D
OP2# A-D
CD# A-D
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XR16L2450IJ-F | IC UART FIFO 1B DUAL 44PLCC |
| XR16L2550IJ-F | IC UART FIFO 16B DUAL 44PLCC |
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| XR16L2552IJ-F | IC UART FIFO 16B DUAL 44PLCC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XR16C872IQ | 制造商:EXAR 制造商全稱:EXAR 功能描述:DUAL UART WITH 1284 PARALLEL PORT AND PLUG-AND-PLAY CONTROLLER |
| XR16L2450 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.25V TO 5.5V DUART |
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