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參數(shù)資料
| 型號(hào)： | XC4085XL-3BG560I |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 2/68頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA I-TEMP 3.3V 3SPD 560MBGA |
| 產(chǎn)品變化通告： | XC4000(XL,XLA,E) Discontinuation 15/Nov/2004 |
| 標(biāo)準(zhǔn)包裝： | 12 |
| 系列： | XC4000E/X |
| LAB/CLB數(shù)： | 3136 |
| 邏輯元件/單元數(shù)： | 7448 |
| RAM 位總計(jì)： | 100352 |
| 輸入/輸出數(shù)： | 448 |
| 門(mén)數(shù)： | 85000 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 560-LBGA，金屬 |
| 供應(yīng)商設(shè)備封裝： | 560-MBGA（42.5x42.5） |
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R
XC4000E and XC4000X Series Field Programmable Gate Arrays
6-14
May 14, 1999 (Version 1.6)
G'
4
G1 G4
F1 F4
C1 C4
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
X6752
4
MUX
F'
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
READ
ADDRESS
READ
ADDRESS
WRITE PULSE
LATCH
ENABLE
LATCH
ENABLE
K
(CLOCK)
WE
D1
D0
EC
WRITE PULSE
MUX
4
Figure 4:
16x2 (or 16x1) Edge-Triggered Single-Port RAM
G'
4
G1 G4
F1 F4
C1 C4
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
X6754
4
MUX
F'
WRITE
DECODER
1 of 16
DIN
16-LATCH
ARRAY
READ
ADDRESS
READ
ADDRESS
WRITE PULSE
LATCH
ENABLE
LATCH
ENABLE
K
(CLOCK)
WE
D1/A4
D0
EC
WRITE PULSE
MUX
4
H'
Figure 5: 32x1 Edge-Triggered Single-Port RAM (F and G addresses are identical)
Product Obsolete or Under Obsolescence
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