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參數(shù)資料
| 型號： | UPD784224YGK-XXX-9EU |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 12.5 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 418/423頁 |
| 文件大?。?/td> | 5526K |
| 代理商： | UPD784224YGK-XXX-9EU |
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94
CHAPTER 4
CLOCK GENERATOR
User’s Manual U12697EJ4V1UD
Example
MOV STBC #byte
NOP
3. When CK2 = 0, the oscillation of the main system clock does not stop even if MCK is set
to 1 (refer to 4.5.1 Main system clock operations).
Remarks 1. fXX: Main system clock frequency (fX or fX/2)
fX: Main system clock oscillation frequency
fXT: Subsystem clock oscillation frequency
2.
×: Don’t care
(2) Oscillation mode selection register (CC)
This register specifies whether clock output from the main system clock oscillator with the same frequency as
the external clock, or clock output that is half of the original frequency is used to operate the internal circuits.
CC is set by a 1-bit or 8-bit memory manipulation instruction.
RESET input sets CC to 00H.
Figure 4-3. Format of Oscillation Mode Selection Register (CC)
Address: 0FF7AH After reset: 00H
R/W
Symbol
7654
3210
CC
ENMP
0
0000
ENMP
Main system clock selection
0
Half of original oscillation frequency
1
Through-rate clock mode
Cautions
1. If the subsystem clock is selected via the standby control mode register (STBC), the
ENMP bit specification becomes invalid.
2. The ENMP bit cannot be reset by software. This bit is reset by a system reset.
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| UPD789104AMC-672-5A4-E1 | 制造商:Renesas Electronics Corporation 功能描述: |
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