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參數(shù)資料
| 型號： | UPD784224YGK-XXX-9EU |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 12.5 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 220/423頁 |
| 文件大?。?/td> | 5526K |
| 代理商： | UPD784224YGK-XXX-9EU |
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297
CHAPTER 18
I2C BUS MODE (
PD784225Y SUBSERIES ONLY)
User’s Manual U12697EJ4V1UD
Figure 18-3. Format of I2C Bus Control Register 0 (IICC0) (1/4)
Address: 0FFB0H
After reset: 00H
R/W
Symbol
7654
3210
IICC0
IICE0
LREL0
WREL0
SPIE0
WTIM0
ACKE0
STT0
SPT0
IICE0
I2C operation enable
0Operation disabled. Presets the I2C bus status register (IICS0). Stops internal operation.
SCL0 and SDA0 lines output low level.
1
Enables operation.
Clear condition (IICE0 = 0)
Set condition (IICE0 = 1)
Cleared by an instruction
Set by an instruction
When RESET is input
LREL0
Release communication
0
Normal operation
1
Releases microcontroller from the current communication and sets it in the wait state. Automatically
clears after execution.
The extended code that is unrelated to the base is used during reception.
The SCL0 and SDA0 lines are put in the high impedance state.
The following flags are cleared.
STD0
ACKD0
TRC0
COI0
EXC0
MSTS0
STT0
SPT0
Until the following communication participation conditions are satisfied, the wait state that released the
microcontroller from communication is entered.
Start as the master after detecting the stop condition.
Address match or extended code reception after the start condition
Clear condition (LREL0 = 0)Note
Set condition (LREL0 = 1)
Automatically cleared after execution.
Set by an instruction
When RESET is input
WREL0
Wait release
0
The wait is not released.
1
The wait is released. After the wait is released, it is automatically cleared.
Clear condition (WREL0 = 0)Note
Set condition (WREL0 = 1)
Automatically cleared after execution.
Set by an instruction
When RESET is input
SPIE0
Enable/disable generation of interrupt request by stop condition detection
0
Disable
1
Enable
Clear condition (SPIE0 = 0)Note
Set condition (SPIE0 = 1)
Cleared by an instruction
Set by an instruction
When RESET is input
Note This flag signal becomes invalid by setting IICE0 to 0.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| UPD784938AGF-188-3BA | 制造商:NEC Electronics Corporation 功能描述: |
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