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參數(shù)資料
| 型號： | UPD784224YGK-XXX-9EU |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 12.5 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, PLASTIC, TQFP-80 |
| 文件頁數(shù)： | 230/423頁 |
| 文件大?。?/td> | 5526K |
| 代理商： | UPD784224YGK-XXX-9EU |
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305
CHAPTER 18
I2C BUS MODE (
PD784225Y SUBSERIES ONLY)
User’s Manual U12697EJ4V1UD
Figure 18-5. Format of Prescaler Mode Register 0 for Serial Clock (SPRM0) (2/2)
SMCNote 1
DFCNote 2
CL1
CL0
Transfer clock
fXX setting allowable range
0
1/0
0
fXX/44
2 to 4.19 MHz
0
1/0
0
1
fXX/86
4.19 to 8.38 MHz
0
1/0
1
0
fXX/172
8.38 to 12.5 MHz
0
1/0
1
TM2 output/66
1
1/0
0
1/0
fXX/24
4 to 8.38 MHz
1
1/0
1
0
fXX/48
8 to 12.5 MHz
1
1/0
1
TM2 output/18
Notes 1. SMC: Bit to change operation mode
0: Operates in normal mode
1: Operates in high-speed mode
2. DFC: Bit to control digital filter operation
0: Digital filter off
1: Digital filter on
Cautions 1. Rewrite the SPRM0 after clearing the IICE0.
2. Set the transfer clock as follows:
When SMC = 0: 100 kHz or below
When SMC = 1: 400 kHz or below
Remarks 1. IICE0: Bit 7 of I2C bus control register 0 (IICC0)
2. The transfer clock does not change due to the ON/OFF setting of bit 2 (DFC) in high-speed mode.
3. IIC clock: Clock frequency when fXX/N is selected
N
× T + tR + tF
N/2
× T
N/2
× T
tR
tF
SCLn
SCLn inverts
IIC clock frequency: fSCL = 1/(N
× T + tR + tF)
T = 1/fXX, tR: SCLn rise time, tF: SCLn fall time
Example When fXX = 12.5 MHz, N = 172, tR = 200 ns, tF = 50 ns
IIC clock frequency: 1/(172
× 80 ns + 200 ns + 50 ns) 71.4 kHz
.
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