參數(shù)資料
型號： TMS320C6421_07
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點數(shù)字信號處理器
文件頁數(shù)： 35/227頁
文件大小： 1671K
代理商： TMS320C6421_07
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www.ti.com
P
TMS320C6421
Fixed-Point Digital Signal Processor
SPRS346B–JANUARY 2007–REVISED APRIL 2007
Table 2-12. EMIFA Terminal Functions (EMIFA Pinout Mode 2, AEM[2:0] = 010) (continued)
SIGNAL
TYPE
(1)
OTHER
(2)(3)
DESCRIPTION
ZWT
NO.
ZDU
NO.
NAME
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[21]/GP[34]
D12
C16
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 21 output
EM_A[21].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[20]/GP[44]
C12
C15
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 20 output
EM_A[20].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[19]/GP[45]
B12
C14
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 19 output
EM_A[19].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[18]/GP[46]
D11
A14
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 18 output
EM_A[18].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[17]/GP[47]
A11
B14
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 17 output
EM_A[17].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[16]/GP[48]
C11
B13
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 16 output
EM_A[16].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[15]/GP[49]
B11
C13
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 15 output
EM_A[15].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[14]/GP[50]
A10
A13
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 14 output
EM_A[14].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[13]/GP[51]
B10
A12
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 13 output
EM_A[13].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[12]/GP[89]
D10
B12
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 12 output
EM_A[12].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[11]/GP[90]
C10
C12
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 11 output
EM_A[11].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[10]/GP[91]
A9
B11
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 10 output
EM_A[10].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[9]/GP[92]
D9
C11
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 9 output EM_A[9].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[8]/GP[93]
B9
A11
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 8 output EM_A[8].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[7]/GP[94]
C9
C10
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 7 output EM_A[7].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[6]/GP[95]
D8
B10
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 6 output EM_A[6].
This pin is multiplexed between EMIFA and GPIO.
IPD
DV
DD33
EM_A[5]/GP[96]
B8
A10
I/O/Z
For EMIFA (AEM[2:0] = 010), this pin is address bit 5 output EM_A[5].
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Device Overview
35
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PDF描述
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