參數(shù)資料
型號： TMS320C6421_07
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點數(shù)字信號處理器
文件頁數(shù)： 31/227頁
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代理商： TMS320C6421_07
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www.ti.com
P
TMS320C6421
Fixed-Point Digital Signal Processor
SPRS346B–JANUARY 2007–REVISED APRIL 2007
Table 2-8. Oscillator/PLL Terminal Functions
SIGNAL
TYPE
(1)
OTHER
(2)
DESCRIPTION
ZWT
NO.
ZDU
NO.
NAME
OSCILLATOR, PLL
Crystal input MXI for MX oscillator (system oscillator, typically 27 MHz).
If the internal oscillator is bypassed, this is the external oscillator clock
input.
(3)
Crystal output for MX oscillator
1.8 V power supply for MX oscillator. On the board, this pin can be
connected to the same 1.8 V power supply as DV
DDR2
.
Ground for MX oscillator
1.8 V power supply for PLLs
MXI/
CLKIN
K19
N22
I
MXV
DD
MXO
J19
M22
O
MXV
DD
MXV
DD
L18
N21
S
(4)
MXV
SS
PLL
PWR18
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
Specifies the operating I/O supply voltage for each signal
For more information on external board connections, see ,
External Clock Input From MXI/CLKIN Pin
.
For more information, see the
Recommended Operating Conditions
table.
K18
L16
M21
N20
GND
S
(4)
(4)
(1)
(2)
(3)
(4)
Table 2-9. Clock Generator Terminal Functions
SIGNAL
TYPE
(1)
OTHER
(2)(3)
DESCRIPTION
ZWT
NO.
ZDU
NO.
NAME
CLOCK GENERATOR
This pin is multiplexed between the System Clock generator (PLL1), PWM2,
and GPIO.
For the System Clock generator (PLL1), it is clock output CLKOUT0. This is
configurable for toggling at the device input clock frequency (MXI/CLKIN
frequency) or other divided-down (/1 to /32) clock outputs.
CLKOUT0/
PWM2/GP[84]
IPD
DV
DD33
M1
R1
I/O/Z
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
IPD = Internal pulldown, IPU = Internal pullup. For more detailed information on pullup/pulldown resistors and situations where external
pullup/pulldown resistors are required, see
Section 3.9.1
,
Pullup/Pulldown Resistors
.
Specifies the operating I/O supply voltage for each signal
(3)
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Device Overview
31
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