參數(shù)資料
型號(hào)： TDA1315
廠商： NXP Semiconductors N.V.
英文描述： Digital audio input/output circuit DAIO
中文描述： 數(shù)字音頻輸入/輸出電路交易代碼
文件頁(yè)數(shù)： 25/36頁(yè)
文件大?。?/td> 411K
代理商： TDA1315
1995 Jul 17
25
Philips Semiconductors
Product specification
Digital audio input/output circuit (DAIO)
TDA1315H
IECIN1 (
PIN
5)
V
i(p-p)
AC input voltage
(peak-to-peak value)
input current
DC bias voltage
0.2
V
DD
V
I
i
V
bias
V
I
= 0 or 5 V; V
DD
= 5 V
±
550
0.5V
DD
μ
A
V
I
2
S-bus interface;
(for timing see Chapter “References”, item 3)
SD
INPUT
/
OUTPUT
(
PIN
35)
t
dSDAUX
output delay with
respect to SDAUX
50
ns
Microcontroller interface
(see Figs 6 and 7)
T
t
HC
t
LC
t
SU;AD
t
HD;AD
t
SU;MA
t
HD;MA
t
SU;MT
t
HD;MT
t
SU;DA
t
HD;DA
t
EN;DT
t
HD;DT
t
3DT
t
halt
LCLK period
LCLK HIGH period
LCLK LOW period
LADDR set-up time
LADDR hold time
LMODE set-up time
LMODE hold time
LMODE set-up time
LMODE hold time
LDATA set-up time
LDATA hold time
LDATA enable time
LDATA hold time
LDATA disable time
LMODE halt time
T
c
+ 50
25
25
25
25
1
2
(T
c
+ 50)
1
2
(T
c
+ 50)
25
25
25
25
1
2
T
c
0
50
T
c
+ 50
50
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
addressing mode
addressing mode
halt mode
halt mode
write and addressing mode
write and addressing mode
data read mode
data read mode; note 3
data read mode
Mode switching and STROBE
(see Fig.10)
t
H;SB
t
L;SB
t
SU;SB
STROBE HIGH time
STROBE LOW time
set-up time before
STROBE
hold time after STROBE
delay LCLK to internal
bit
SD enable time
SD and INVALID disable
time
WS, SCK and INVALID
enable time
WS and SCK disable
time
SYSCLKO enable time
3T
c
+ 50
3T
c
+ 50
T
c
+ 50
ns
ns
ns
for pins or bits
t
HD;SB
t
DBIT
for pins or bits
control register
2T
c
+ 50
2T
c
3T
c
+ 50
ns
ns
t
EN;SD
t
3SD
T
c
2T
c
+ 50
T
c
+ 50
ns
ns
t
EN;WS
T
c
2T
c
+ 50
ns
t
3WS
T
c
2T
c
+ 50
ns
t
EN;CO
T
c
2T
c
+ 50
ns
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
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