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參數(shù)資料
| 型號： | TC86R4600 |
| 廠商： | Toshiba Corporation |
| 英文描述： | 64 Bit RISC Microprocessor(64位精簡指令集微處理器) |
| 中文描述： | 64位RISC微處理器（64位精簡指令集微處理器） |
| 文件頁數(shù)： | 18/30頁 |
| 文件大小： | 267K |
| 代理商： | TC86R4600 |
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TC86R4600 64-bit RISC Microprocessor
16
T O S H IB A A M E R IC A E L E C T R O N IC C O M P O N E N T S , IN C
.
Pin Description
The following is a list of interface, interrupt, and miscellaneous pins available on the R4600.
Pin Name
Type
Description
Systeminterface:
ExtRqst*
Input
External request
Signals that the systeminterface needs to submt an external request.
Release*
Output
Release interface
Signals that the processor is releasing the systeminterface to slave state.
RdRdy*
Input
Read Ready
Signals that an external agent can nowaccept a processor read request.
WrRdy*
Input
Write Ready
Signals that an external agent can nowaccept a processor write request.
ValidIn*
Input
Valid Input
Signals that an external agent is nowdriving a valid address or data on the SysAD bus and a valid command or data identifier
on the SysCmd bus.
ValidOut*
Output
Valid output
Signals that the processor is nowdriving a valid address or data on the SysAD bus and a valid command or data identifier on
the SysCmd bus.
SysAD(63:0)
Input/Output
Systemaddress/data bus
A 64-bit address and data bus for communication between the processor and an external agent.
SysADC(7:0)
Input/Output
Systemaddress/data check bus
An 8-bit bus containing parity check bits for the SysAD bus.
SysCmd(8:0)
Input/Output
Systemcommand/data identifier bus
A 9-bit bus for command and data identifier transmssion between the processor and an external agent.
SysCmdP
Input/Output
Systemcommand/data identifier bus parity
A single, even-parity bit for the SysCmd bus.
Clock/control interface:
MasterClock
Input
Master clock
Master clock input at the processor operating frequency.
MasterOut
Output
Master clock out
Master clock output aligned wth MasterClock.
RClock(1:0)
Output
Receive clocks
Two identical receive clocks at the systeminterface frequency.
TClock(1:0)
Output
Transmt clocks
Two identical transmt clocks at the systeminterface frequency.
IOOut
Output
Reserved for future output
Always HIGH.
IOIn
Input
Reserved for future input
Should be driven high.
SyncOut
Output
Synchronization clock out
Synchronization clock output. Must be connected to SyncIn through an interconnect that models the interconnect between
MasterOut, TClock, RClock, and the external agent.
SyncIn
Input
Synchronization clock in
Synchronization clock input. See SyncOut.
Fault*
Output
Fault
Always HIGH.
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