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參數(shù)資料
| 型號： | ST7PLITE05Y0M3 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO16 |
| 封裝： | 0.150 INCH, PLASTIC, SOP-16 |
| 文件頁數(shù)： | 110/115頁 |
| 文件大小： | 781K |
| 代理商： | ST7PLITE05Y0M3 |
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ST7FLITE0
94/115
13.8 I/O PORT PIN CHARACTERISTICS
13.8.1 General Characteristics
Subject to general operating conditions for VDD,fOSC, and TA unless otherwise specified.
Notes:
1. Data based on characterization results, not tested in production.
2. Configuration not recommended, all unused pins must be kept at a fixed voltage: using the output mode of the I/O for
example or an external pull-up or pull-down resistor (see Figure 67). Data based on design simulation and/or technology
characteristics, not tested in production.
3. The RPU pull-up equivalent resistor is based on a resistive transistor (corresponding IPU current characteristics de-
scribed in Figure 68).
4. To generate an external interrupt, a minimum pulse width has to be applied on an I/O port pin configured as an external
interrupt source.
Figure 67. Two typical Applications with unused I/O Pin
Figure 68. Typical IPU vs. VDD with VIN=VSS
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIL
Input low level voltage
0.3xVDD
V
VIH
Input high level voltage
0.7xVDD
Vhys
Schmitt trigger voltage
hysteresis 1)
400
mV
IL
Input leakage current
VSS≤VIN≤VDD
±1
A
IS
Static current consumption 2)
Floating input mode
200
RPU
Weak pull-up equivalent
resistor3)
VIN=VSS
VDD=5V
50
120
250
k
VDD=3V
160
CIO
I/O pin capacitance
5
pF
tf(IO)out
Output high to low level fall
time 1)
CL=50pF
Between 10% and 90%
25
ns
tr(IO)out
Output low to high level rise
time 1)
25
tw(IT)in
External interrupt pulse time 4)
1tCPU
10k
UNUSED I/O PORT
ST7XXX
10k
UNUSED I/O PORT
ST7XXX
VDD
TO BE CHARACTERIZED
0
10
20
30
40
50
60
70
80
90
2
2.5
3
3.5
4
4.5
5
5.5
6
Vdd(V)
Ipu(uA)
Ta=1 40
°C
Ta=9 5
°C
Ta=2 5
°C
Ta=-45
°C
1
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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