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參數(shù)資料
| 型號： | ST16C1450IQ48-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 225/295頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART FIFO 1B 48TQFP |
| 標準包裝： | 250 |
| 特點： | * |
| 通道數(shù)： | 1，UART |
| FIFO's： | 1 字節(jié) |
| 電源電壓： | 2.97 V ~ 5.5 V |
| 帶故障啟動位檢測功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-TQFP |
| 供應商設備封裝： | 48-TQFP（7x7） |
| 包裝： | 托盤 |
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8201, 8202, 8203, 8204 Acceleration Processor Data Sheet, DS-0157-05
Page 35
Exar Confidential
2.1.4
Data Integrity Model for Encode Operations
This section describes the data integrity model for encode operations using the parity, CRC,
ECC and engine real time verification features described in the previous sections. Figure 2-
6 illustrates the model described below.
Raw data with a PCIe standard CRC (ECRC) from the host enters the 820x over the PCIe
bus through the 820x PCIe core. The PCIe core verifies the ECRC and generates parity
before writing the data into RAM and into the PCIe Inbound Manager (PIM). The PIM
verifies the parity and generates an 8-bit Error Correction Code (ECC8) and enters the data
plus the ECC8 into the source buffer. When a Channel Manager reads the data from the
source buffer, it first verifies the ECC, generates a CRC, and sends the raw data and CRC
to the Compression engine. The Compression engine compresses the data and CRC,
performs real time verification by decompressing the data and verifying the CRC, and sends
the data to the Pad engine. The Pad engine adds padding to the data stream, and sends the
padded data to the encryption engine (the Pad engine does not perform any real time
verification). The Encryption engine encrypts the padded compressed data, performs real
time verification, and sends the result to the Hash engine. The Hash engine calculates the
MAC and performs real time verification on the hash result.
An 8-bit ECC is added to the output data of the Encryption engine and written into the
result buffer. The Channel Manager reads the data from the result buffer, verifies the ECC,
and sends the data to the PCIe Outbound Manager (POM). The POM adds parity before
writing the data into the PCIe Core RAM. When data is read from the PCIe Core RAM by the
PIM, the parity is first verified and an ECRC is generated before the final transformed data
is sent to the host.
Figure 2-5. Hash Engine Real Time Verification
相關PDF資料 |
PDF描述 |
|---|---|
| XR68M752IL32-F | IC UART FIFO 64B DUAL 32QFN |
| XR16M752IL32-F | IC UART FIFO 64B DUAL 32QFN |
| ST16C1450IJ28-F | IC UART FIFO 1B 28PLCC |
| ST16C1450CQ48-F | IC UART FIFO 1B 48TQFP |
| ST16C450IJ44-F | IC UART SINGLE 44PLCC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ST16C1450IQ48TR-F | 制造商:Exar Corporation 功能描述:UART 1-CH 1Byte FIFO 3.3V/5V 48-Pin TQFP T/R 制造商:Exar Corporation 功能描述:ST16C1450IQ48TR-F |
| ST16C1451 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
| ST16C1451CJ28 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
| ST16C1451CP28 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
| ST16C1451CQ48 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
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