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參數(shù)資料
| 型號： | ST16C1450IQ48-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 21/295頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART FIFO 1B 48TQFP |
| 標準包裝： | 250 |
| 特點： | * |
| 通道數(shù)： | 1，UART |
| FIFO's： | 1 字節(jié) |
| 電源電壓： | 2.97 V ~ 5.5 V |
| 帶故障啟動位檢測功能： | 是 |
| 帶調制解調器控制功能： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-TQFP |
| 供應商設備封裝： | 48-TQFP（7x7） |
| 包裝： | 托盤 |
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8201, 8202, 8203, 8204 Acceleration Processor Data Sheet, DS-0157-05
Page 117
Exar Confidential
5.3.4
Channel Manager Result Buffer
The Result Buffer is used to temporarily store the destination data generated by the
processing engines. Unlike source data, destination data is stored into the result buffer in
the order that the commands complete and is fetched using the same sequence, therefore
it mimics a FIFO.
The size of the write request payload must not exceed the parameter max_payload_size.
The host software sets this parameter during initialization and is typically set to 128 bytes.
If the result buffer is 1KB deep, it can accommodate 8 TLPs.
The result buffer is implemented as a dual-port 1K-byte memory. The data bus width is 72-
bits (64 bits of data and 8 bits of ECC).
Note: The 820x supports a maximum payload size, max_payload_size, of 128, 256 or 512
bytes. If the host configures the max read request size to 1KB or 2KB, the 820x will still
send 512B read requests over the PCIe interface.
5.3.5
Channel Manager Data Process Controller
The Data Process Controller (DPC) controls the data process flow and interface with all
processing engines. The main functions of the Data Process Controller are:
Separate the information bus from the source buffer, and feed the information bus
field to the processing engines
Read and align the data from the source buffer, and feed the source data to
processing engines
Verify the Key CRC if the command uses an the key
For encode operations, append a CRC to the source data or verify the CRC of input
data
For decode operations, verify the data CRC
Read the result data from the processing engines; align and write the data into the
result buffer
Control the encode and decode data flow
5.4 PKP Manager
The PKP Manager controls the flow of fetching instructions and operand data from host
memory to the PKP engine, and the flow of transmitting the calculated results from the PKP
engine to host memory.
相關PDF資料 |
PDF描述 |
|---|---|
| XR68M752IL32-F | IC UART FIFO 64B DUAL 32QFN |
| XR16M752IL32-F | IC UART FIFO 64B DUAL 32QFN |
| ST16C1450IJ28-F | IC UART FIFO 1B 28PLCC |
| ST16C1450CQ48-F | IC UART FIFO 1B 48TQFP |
| ST16C450IJ44-F | IC UART SINGLE 44PLCC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| ST16C1450IQ48TR-F | 制造商:Exar Corporation 功能描述:UART 1-CH 1Byte FIFO 3.3V/5V 48-Pin TQFP T/R 制造商:Exar Corporation 功能描述:ST16C1450IQ48TR-F |
| ST16C1451 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
| ST16C1451CJ28 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
| ST16C1451CP28 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
| ST16C1451CQ48 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.97V TO 5.5V UART |
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