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參數(shù)資料
| 型號： | SPAK56855BU120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| 封裝： | LQFP-100 |
| 文件頁數(shù)： | 563/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56855BU120 |
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B-136
DSP56F801/803/805/807 User’s Manual
MOTOROLA
Preliminary
Application:
Date:
Programmer:
Sheet
C
B
1 of 10
Bits
Name
Description
8
HRMS
Host Request Mode Select
The Host mode Select (HRMS) bit controls the host request pins
7
HDDS
Host Dual Data Strobe
When the Host Dual Data Strobe (HDDS) bit is set, the HI8 operates in the Dual Data Strobe
Bus mode; a host bus with separated read and write data strobes. When cleared, the HI8
operates in the Single Strobe Bus mode, i.e. a Host bus with a single Data Strobe signal.
6
TDMAEN
DSP Side Transmit DMA Enable
The TDMAEN bit is used to enable DSP side Transmit DMA operations. When set, the on-chip
DMA controller handles transferring data between the HTX register and DSP memory. The
on-chip DMA controller must be appropriately configured to implement the desired data transfer.
5
RDMAEN
DSP Side Receive DMA Enable
The RDMAEN bit is used to enable DSP side Receive DMA operations. When set, the on-chip
DMA controller handles transferring data between the HRX register and DSP memory. The
on-chip DMA controller must be appropriately configured to implement the desired data transfer.
4
HF2
Host Flags 2 and 3
3HF3
The Host Flag 2 and Host Flag 3 (HF2 and HF3) bits are used as general purpose flags for
DSP-to-Host communication. HF2 and HF3 may be set or cleared by the DSP core. HF2 and
HF3 are reflected in the Interrupt Status Register (ISR) on the Host Side if they are modified by
the DSP software, the host processor can read the modified values by reading the ISR.
2
HCIE
Host Command Interrupt Enable
The HCIE bit is used to enable a DSP core interrupt when the HCP status bit in the HSR is set.
When cleared, HCP interrupts are disabled. When set, a Host Command Interrupt request
occurs if HCP is set. The interrupt address is determined by the Host Command Vector
Register. Cleared on hardware reset.
1
HTIE
Host Transmit Interrupt Enable
The HTIE bit is used to enable a DSP core interrupt when the Host Transmit Data Empty status
bit in the HSR is set. When cleared, HTDE interrupts are disabled. When set, a Host Transmit
Data Interrupt request occurs when the HTDE bit is set. It is cleared on hardware reset.
0
HRIE
Host Receive Interrupt Enable
The HRIE bit is used to enable a DSP core interrupt when the Host Receive Data Full (HRDF)
status bit in the Host Status Register (HSR) is set. When cleared, HRDF interrupts are disabled.
When set, a Host Receive Data Interrupt request occurs if the HRDF bit is also set. It is cleared
on hardware reset.
HI8 Host Control
Register (HCR)
$1FFFD8 + $0
Bits
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
HRMS HDDS TDMAEN REDMAEN HF3 HF2 HCIE HTIE HRIE
Write
0
RESET
0
000
00
0
HI8 Host Control Register (HCR)
HI8
denotes Reserved Bits
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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