(VDD33 = 3.3 V ±5%, T
參數(shù)資料
型號： SI5364-G-BC
廠商： Silicon Laboratories Inc
文件頁數(shù)： 36/38頁
文件大?。?/td> 0K
描述： IC PREC PORT CARD CLOCK 99CBGA
標準包裝： 176
系列： DSPLL®
類型： 時鐘發(fā)生器
PLL： 是
輸入： 時鐘
輸出： CML
電路數(shù)： 1
比率 - 輸入:輸出： 3:4
差分 - 輸入:輸出： 是/是
頻率 - 最大： 675MHz
除法器/乘法器： 無/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -20°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 99-BCBGA
供應(yīng)商設(shè)備封裝： 99-CBGA（11x11）
包裝： 托盤
其它名稱： 336-1280
Si5364
Rev. 2.5
7
Table 2. DC Characteristics
(VDD33 = 3.3 V ±5%, TA = –20 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Supply Current
Single Clock Output
Four Clock Outputs
IDD
fout = 19.44 MHz
—
120
212
140
240
mA
Power Dissipation Using 3.3 V Supply
Single Clock Output
Four Clock Outputs
PD
fout = 19.44 MHz
—
396
700
462
792
mW
Common Mode Input Voltage1,2,3
(CLKIN_A, CLKIN_B, REF/CLKIN_F)
VICM
1.0
1.5
2.0
V
Single-Ended Input Voltage2,3,4
(CLKIN_A, CLKIN_B, REF/CLKIN_F)
VIS
200
—
5004
mVPP
Differential Input Voltage Swing2,3,4
(CLKIN_A, CLKIN_B, REF/CLKIN_F)
VID
200
—
5004
mVPP
Input Impedance
(CLKIN_A+, CLKIN_A-, CLKIN_B+, CLKIN_B–,
REF/CLKIN_F+,
REF/CLKIN_F–)
RIN
—80
—
k
Ω
Differential Output Voltage Swing
(CLKOUT_[3:0])
VOD
100
Ω Load
Line-to-Line
816
906
1100
mVPP
Output Common Mode Voltage
(CLKOUT_[3:0])
VOCM
100
Ω Load
Line-to-Line
1.4
1.8
2.2
V
Output Short to GND (CLKOUT_[3:0])
ISC(–)
–60
—
mA
Output Short to VDD25 (CLKOUT_[3:0])
ISC(+)
—
–45
—
mA
Input Voltage Low (LVTTL Inputs)
VIL
——
0.8
V
Input Voltage High (LVTTL Inputs)
VIH
2.0
—
V
Input Low Current (LVTTL Inputs)
IIL
——
50
μA
Input High Current (LVTTL Inputs)
IIH
——
50
μA
Input Impedance (LVTTL Inputs)
RIN
50
—
k
Ω
Internal Pulldown (LVTTL inputs)
Ipd
——
50
μA
FSYNC Output Charge Current
IOH_FSYNC
VFSYNC =0V
CLOAD =10pF
100
—
μA
FSYNC Output Discharge Current
IOL_FSYNC
VFSYNC =VDD
CLOAD =10pF
320
—
μA
Notes:
1. The Si5364 device provides weak 1.5 V internal biasing that enables ac-coupled operation.
2. Clock inputs may be driven differentially or single-endedly. When driven single-endedly, the unused input should be ac-
coupled to ground.
3. Transmission line termination, when required, must be provided externally.
4. Although the Si5364 device can operate with input clock swings as high as 1500 mVPP, Silicon Laboratories recommends
maintaining the input clock amplitude below 500 mVPP for optimal performance.
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