參數(shù)資料
型號： SI5338-EVB
廠商： Silicon Laboratories Inc
文件頁數(shù)： 26/44頁
文件大?。?/td> 0K
描述： BOARD EVALUATION SI5338
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： Si5338
主要屬性： LVPECL/LVDS：160 kHz 至 700 MHz，<1 ps RMS 標(biāo)準(zhǔn)抖動(dòng)，零 ppm 頻率錯(cuò)誤
次要屬性： 基于 USB 的 GUI，用于編程，I2C/SMBus 兼容接口，1.8、2.5 或 3.3 V
已供物品： 板，線纜，CD，樣品
產(chǎn)品目錄頁面： 628 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： 336-1555-5-ND - IC CLK GEN QUAD 200MHZ 24-QFN
336-1554-5-ND - IC CLK GEN QUAD 350MHZ 24-QFN
336-1553-5-ND - IC CLK GEN QUAD 700MHZ 24-QFN
其它名稱： 336-1556
Si5338
32
Rev. 1.3
7. Pin Descriptions
Note: Center pad must be tied to GND for normal operation.
Table 16. Si5338 Pin Descriptions
Pin #
Pin Name
I/O
Signal Type
Description
1,2
IN1/IN2
I
Multi
CLKIN/CLKINB.
These pins are used as the main differential clock input or as the
Figure 4, for connection details. Clock inputs to these pins must be
ac-coupled. Keep the traces from pins 1,2 to the crystal as short as
possible and keep other signals and radiating sources away from
the crystal.
When not in use, leave IN1 unconnected and IN2 connected to
GND.
IN1
CLK2B
CLK2A
VDDO2
VDDO1
CLK1B
CLK1A
VDD
SCL
CLK3A
CL
K
3
B
INTR
SDA
VDDO0
CLK0B
CL
K
0
A
RSVD_G
ND
VDDO3
GND
Pad
5
4
3
2
1
6
13
10
9
8
7
IN2
IN3
IN4
IN5
IN6
Top View
11
12
15
14
16
17
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19
20
21
22
23
24
相關(guān)PDF資料
PDF描述
H3AAH-2606G IDC CABLE - HSC26H/AE26G/HSC26H
0982660138 CBL 12POS 0.5MM JMPR TYPE D 1'
0982661084 CBL 37POS 0.5MM JMPR TYPE D 6"
HMC08DRTH CONN EDGECARD 16POS DIP .100 SLD
EBC43DCSD-S288 CONN EDGECARD 86POS .100 EXTEND
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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Si5338F-B-GM 功能描述:時(shí)鐘發(fā)生器及支持產(chǎn)品 I2C-PRGRMBL clock generatr 0.16-200MHz RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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