(VDD =3.3 V ±5%, T
參數(shù)資料
型號: SI5013-EVB
廠商: Silicon Laboratories Inc
文件頁數(shù): 25/26頁
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描述: BOARD EVALUATION FOR SI5013
標準包裝: 1
主要目的: 計時,時鐘和數(shù)據(jù)恢復(fù)(CDR)
已用 IC / 零件: SI5013
已供物品:
其它名稱: 336-1123
Si5013
8
Rev. 1.6
Table 3. AC Characteristics (Clock and Data)
(VDD =3.3 V ±5%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Output Clock Rate
fCLK
Rate Sel = 1
Rate Sel = 0
616
154
675
158
MHz
Output Rise Time—OC-12
tR
125
155
ps
Output Fall Time—OC-12
tF
125
155
ps
Output Clock Duty Cycle—
OC-12/3
47
50
53
% of
UI
Clock to Data Delay
OC-12
OC-3
tCr-D
800
4000
860
4100
940
4200
ps
Clock to Data Delay
OC-12
OC-3
tCf-D
0
800
35
850
70
1000
ps
Input Return Loss
100 kHz–622 MHz
–15
dB
Slicing Level Offset
(relative to the internally set
input common mode voltage)
VSLICE
SLICE_LVL = 750 mV to 2.25 V
Loss-of-Signal Range*
(peak-to-peak differential)
VLOS
LOS_LVL = 1.50 to 2.50 V
0
40
mV
Loss-of-Signal Response Time
tLOS
8
20
25
s
*Note: Adjustment voltage is calculated as follows:
VLOS = (LOS_LVL – 1.50)/25.
相關(guān)PDF資料
PDF描述
GBC18DRTI-S734 CONN EDGECARD 36POS DIP .100 SLD
ECM25DCTN CONN EDGECARD 50POS DIP .156 SLD
XR16V554IL-0A-EVB EVAL BOARD FOR XR16V554 48QFN
RPP30-2424SW CONV DC/DC 30W 9-36VIN 24VOUT
1-5492191-7 CA SM LDS SCAPC-SC/UPC(NG)
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參數(shù)描述
SI5013-X-GM 制造商:未知廠家 制造商全稱:未知廠家 功能描述:OC-12/3, STM-4/1 SONET/SDH CDR IC WITH LIMITING AMPLIFIER
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