DD = 2.7 to 3.6 V, T
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    參數(shù)資料
    型號(hào): SI4113M-EVB
    廠商: Silicon Laboratories Inc
    文件頁數(shù): 33/36頁
    文件大?。?/td> 0K
    描述: BOARD EVALUATION FOR SI4113
    標(biāo)準(zhǔn)包裝: 1
    類型: 合成器
    適用于相關(guān)產(chǎn)品: SI4113
    已供物品: 板,CD
    其它名稱: 336-1100
    Si4133
    6
    Rev. 1.61
    Figure 1. SCLK Timing Diagram
    Table 4. Serial Interface Timing
    (V
    DD = 2.7 to 3.6 V, TA = –40 to 85 °C)
    Parameter1
    Symbol
    Test Condition
    Min
    Typ
    Max
    Unit
    SCLK Cycle Time
    tclk
    40
    ns
    SCLK Rise Time
    tr
    50
    ns
    SCLK Fall Time
    t
    f
    50
    ns
    SCLK High Time
    th
    10
    ns
    SCLK Low Time
    tl
    10
    ns
    SDATA Setup Time to SCLK
    2
    t
    su
    5
    ns
    SDATA Hold Time from SCLK
    2
    thold
    0
    ns
    SEN
    to SCLKDelay Time2
    ten1
    10
    ns
    SCLK
    to SENDelay Time2
    t
    en2
    12
    ns
    SEN
    to SCLKDelay Time2
    ten3
    12
    ns
    SEN Pulse Width
    tw
    10
    ns
    Notes:
    1. All timing is referenced to the 50% level of the waveforms unless otherwise noted.
    2. Timing is not referenced to 50% level of the waveform. See Figure 2.
    SCLK
    80%
    20%
    50%
    t
    r
    t
    f
    t
    l
    t
    clk
    t
    h
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