參數(shù)資料
型號(hào)： SH7615
廠商： Hitachi,Ltd.
英文描述： CMOS single-chip microcontroller
中文描述： CMOS單芯片微控制器
文件頁數(shù)： 8/873頁
文件大?。?/td> 2741K
代理商： SH7615
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iv
5.4.2
Interrupt Response Time.................................................................................................... 190
Sampling of Pins
IRL3
–
IRL0
........................................................................................... 192
Usage Notes ....................................................................................................................... 193
Stack State after Interrupt Exception Handling.................................................... 190
5.5
5.6
5.7
Section 6
6.1
User Break Controller (UBC)
...................................................................... 197
Overview............................................................................................................................ 197
6.1.1
Features................................................................................................................. 197
6.1.2
Block Diagram...................................................................................................... 198
6.1.3
Register Configuration.......................................................................................... 199
Register Descriptions......................................................................................................... 201
6.2.1
Break Address Register A (BARA)...................................................................... 201
6.2.2
Break Address Mask Register A (BAMRA)........................................................ 202
6.2.3
Break Bus Cycle Register A (BBRA) .................................................................. 203
6.2.4
Break Address Register B (BARB)...................................................................... 205
6.2.5
Break Address Mask Register B (BAMRB)......................................................... 206
6.2.6
Break Bus Cycle Register B (BBRB)................................................................... 207
6.2.7
Break Address Register C (BARC)...................................................................... 209
6.2.8
Break Address Mask Register C (BAMRC)......................................................... 210
6.2.9
Break Data Register C (BDRC)............................................................................ 212
6.2.10 Break Data Mask Register C (BDMRC).............................................................. 213
6.2.11 Break Bus Cycle Register C (BBRC)................................................................... 215
6.2.12 Break Execution Times Register C (BETRC)...................................................... 216
6.2.13 Break Address Register D (BARD)...................................................................... 217
6.2.14 Break Address Mask Register D (BAMRD)........................................................ 218
6.2.15 Break Data Register D (BDRD) ........................................................................... 220
6.2.16 Break Data Mask Register D (BDMRD).............................................................. 221
6.2.17 Break Bus Cycle Register D (BBRD) .................................................................. 223
6.2.18 Break Execution Times Register D (BETRD)...................................................... 224
6.2.19 Break Control Register (BRCR)........................................................................... 225
6.2.20 Branch Flag Registers (BRFR)............................................................................. 231
6.2.21 Branch Source Registers (BRSR)......................................................................... 232
6.2.22 Branch Destination Registers (BRDR)................................................................. 233
Operation............................................................................................................................ 234
6.3.1
User Break Operation Sequence........................................................................... 234
6.3.2
Instruction Fetch Cycle Break.............................................................................. 235
6.3.3
Data Access Cycle Break...................................................................................... 236
6.3.4
Saved Program Counter (PC) Value..................................................................... 237
6.3.5
X Memory Bus or Y Memory Bus Cycle Break .................................................. 237
6.3.6
Sequential Break................................................................................................... 238
6.3.7
PC Traces.............................................................................................................. 239
6.3.8
Examples of Use................................................................................................... 241
6.3.9
Usage Notes.......................................................................................................... 246
6.2
6.3
相關(guān)PDF資料
PDF描述
SH7706 Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series
SH7708 32-bit RISC (reduced instruction set computer) microcomputers
SH7708R 32-bit RISC (reduced instruction set computer) microcomputers
SH7708S 32-bit RISC (reduced instruction set computer) microcomputers
SH7729 Hitachi Microcomputer Development Environment System
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SH7708 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine
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