參數(shù)資料
型號(hào)： SH7615
廠商： Hitachi,Ltd.
英文描述： CMOS single-chip microcontroller
中文描述： CMOS單芯片微控制器
文件頁數(shù)： 568/873頁
文件大?。?/td> 2741K
代理商： SH7615
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555
In IrDA communication mode, bit 5 is the IrDA clock select 2 (ICK2) bit, enabling appropriate
clock pulses to be generated according to its setting. See Pulse Width Selection, in section 14.3.6,
Operation in IrDA Mode, for details.
Bit 4—Parity Mode (O/
E
)/IrDA Clock Select 1 (ICK1): Selects either even or odd parity for use in
parity addition and checking. The O/
E
bit setting is only valid when the PE bit is set to 1, enabling
parity bit addition and checking, in asynchronous mode. The O/
E
bit setting is invalid in
synchronous mode, and when parity addition and checking is disabled in asynchronous mode.
Bit 4: O/
E
Description
0
Even parity
*
1
(Initial value)
1
Notes: 1. When even parity is set, parity bit addition is performed in transmission so that the total
number of 1-bits in the transmit character plus the parity bit is even. In reception, a
check is performed to see if the total number of 1-bits in the receive character plus the
parity bit is even.
2. When odd parity is set, parity bit addition is performed in transmission so that the total
number of 1-bits in the transmit character plus the parity bit is odd. In reception, a check
is performed to see if the total number of 1-bits in the receive character plus the parity
bit is odd.
Odd parity
*
2
In IrDA communication mode, bit 4 is the IrDA clock select 1 (ICK1) bit, enabling appropriate
clock pulses to be generated according to its setting. See Pulse Width Selection, in section 14.3.6,
Operation in IrDA Mode, for details.
Bit 3—Stop Bit Length (STOP)/IrDA Clock Select 0 (ICK0): Selects 1 or 2 bits as the stop bit
length in asynchronous mode. The STOP bit setting is only valid in asynchronous mode. When
synchronous mode is set, the STOP bit setting is invalid since stop bits are not added.
Bit 3: STOP
Description
0
1 stop bit
*
1
(Initial value)
1
Notes: 1. In transmission, a single 1-bit (stop bit) is added to the end of a transmit character
before it is sent.
2. In transmission, two 1-bits (stop bits) are added to the end of a transmit character
before it is sent.
2 stop bits
*
2
In reception, only the first stop bit is checked, regardless of the STOP bit setting. If the second
stop bit is 1, it is treated as a stop bit; if it is 0, it is treated as the start bit of the next transmit
character.
In IrDA communication mode, bit 3 is the IrDA clock select 0 (ICK0) bit, enabling appropriate
clock pulses to be generated according to its setting. See Pulse Width Selection, in section 14.3.6,
Operation in IrDA Mode, for details.
相關(guān)PDF資料
PDF描述
SH7706 Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series
SH7708 32-bit RISC (reduced instruction set computer) microcomputers
SH7708R 32-bit RISC (reduced instruction set computer) microcomputers
SH7708S 32-bit RISC (reduced instruction set computer) microcomputers
SH7729 Hitachi Microcomputer Development Environment System
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參數(shù)描述
SH7616 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-Bit RISC Microcomputer SuperH™ RISC engine Family/SH7600 Series
SH7618 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-Bit RISC Microcomputer SuperHTM RISC engine Family / SH7618 Series
SH7618A 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-Bit RISC Microcomputer SuperHTM RISC engine Family / SH7618 Series
SH7641 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas 32-Bit RISC Microcomputer SuperH? RISC engine Family / SH7641 Series
SH7708 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SuperHa?￠ RISC engine
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