參數(shù)資料
型號： S3P863A-QZ
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 12 MHz, MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, QFP-44
文件頁數(shù)： 21/397頁
文件大?。?/td> 1373K
代理商： S3P863A-QZ
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INTERRUPT STRUCTURE
S3C8639/C863A/P863A/C8647/F8647
5-18
Programming Guidelines
Remember that the only way to enable/disable a fast interrupt is to set/clear the fast interrupt enable bit in the
SYM register, SYM.1. Executing an EI or DI instruction globally enables or disables all interrupt processing,
including fast interrupts.
NOTE
If you use fast interrupts, remember to load the IP with a new start address when the fast interrupt service
routine ends.
F
F PROGRAMMING TIP — Setting Up the Interrupt Control Structure
This example shows you how to enable interrupts for select interrupt sources, disable interrupts for other sources,
and set interrupt priorities for the S3C8639/C863A/C8647 interrupt structure. The following is a sample program:
— Disables the watchdog function.
— Enables the following interrupts: P0.0 external interrupt, timer M0 capture/overflow, timer M1
capture/overflow, timer M2 interval interrupt, and DDC interrupt.
— Disables the following interrupts: P0.1 and P0.2 external interrupts, and slave only IIC-bus interrupt.
— Sets interrupt priorities as P0.0 > timer M2 > timer M0 > timer M1 > DDC.
DI
; Disable interrupts globally
LD
BTCON,#0A0H
; Disable watchdog function
LD
P0CONL,#01H
; P0.0
← enable rising edge interrupts
LD
P0INT,#01H
; Enable P0.0 external interrupt
; Disable P0.1 and P0.2 external interrupts
LD
TM0CON,#8FH
; Enable timer M0 capture interrupt
; (capture on rising edges)
; Enable timer M0 overflow interrupt
LD
TM1CON,#3CH
; Enable timer M1 capture/overflow interrupt
LD
TM2CON,#3DH
; Enable timer M2 interval interrupt
LD
TM2DATA,#249
; Setting 1ms interval
LD
DCCR,#0A3H
; Enable DDC interrupt, SCL clock = 100 kHz
LD
IMR,#1FH
; Enable interrupt levels IRQ0, IRQ1, IRQ2, IRQ3 and
; IRQ4
LD
IPR,#1EH
; IRQ4 > IRQ0 > IRQ1 > IRQ2 > IRQ3
; (P0.0 > timer M0 > timer M2 > timer M1 > DDC)
EI
; Enable interrupts globally
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