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參數(shù)資料
| 型號： | S1C33205D00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, UUC158 |
| 封裝： | DIE-158 |
| 文件頁數(shù)： | 157/564頁 |
| 文件大?。?/td> | 3533K |
| 代理商： | S1C33205D00E100 |
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1
OUTLINE
A-10
EPSON
S1C33205 PRODUCT PART
Pin name
Pin No.
I/O
Pull-up
Function
P26
TM4
SOUT2
3
I/O
–
P26:
I/O port when CFP26(D6/0x402D8) = "0" (default)
TM4:
16-bit timer 4 output when CFP26(D6/0x402D8) = "1"
SOUT2:
Serial I/F Ch. 2 data output when SSOUT2(D1/0x402DB) = "1" and
CFP26(D6/0x402D8) = "0"
P27
TM5
SIN2
4
I/O
–
P27:
I/O port when CFP27(D7/0x402D8) = "0" (default)
TM5:
16-bit timer 5 output when CFP27(D7/0x402D8) = "1"
SIN2:
Serial I/F Ch. 2 data input when SSIN2(D0/0x402DB) = "1" and
CFP27(D7/0x402D8) = "0"
P30
#WAIT
#CE4&5
69
I/O
–
P30:
I/O port when CFP30(D0/0x402DC) = "0" (default)
#WAIT:
Wait cycle request input when CFP30(D0/0x402DC) = "1"
#CE4&5:
Areas 4&5 chip enable when CFP30(D0/0x402DC) = "1" and
IOC30(D0/0x402DE) = "1"
P31
#BUSGET
#GARD
68
I/O
–
P31:
I/O port when CFP31(D1/0x402DC) = "0" and CFEX3(D3/0x402DF) = "0"
(default)
#BUSGET:
Bus status monitor signal output for successive RAS mode when
CFP31(D1/0x402DC) = "1" and CFEX3(D3/0x402DF) = "0"
#GARD:
Area read signal output for GA when CFEX3(D3/0x402DF) = "1"
P32
#DMAACK0
#SRDY3
HDQM
67
I/O
–
P32:
I/O port when CFP32(D2/0x402DC) = "0" and SDRENA(D7/0x39FFC1)
= "0" (default)
#DMAACK0: HSDMA Ch. 0 acknowledge output when CFP32(D2/0x402DC) = "1" and
SDRENA(D7/0x39FFC1) = "0"
#SRDY3:
Serial I/F Ch.3 ready signal input/output when SSRDY3(D3/0x402D7) =
"1", CFP32(D2/0x402DC) = "0" and SDRENA(D7/0x39FFC1) = "0"
HDQM:
SDRAM data (high byte) input/output mask signal when
SDRENA(D7/0x39FFC1) = "1"
P33
#DMAACK1
SIN3
SDA10
62
I/O
–
P33:
I/O port when CFP33(D3/0x402DC) = "0" and SDRENA(D7/0x39FFC1)
= "0" (default)
#DMAACK1: HSDMA Ch. 1 acknowledge output when CFP33(D3/0x402DC) = "1" and
SDRENA(D7/0x39FFC1) = "0"
SIN3:
Serial I/F Ch. 3 data input when SSIN3(D0/0x402D7) = "1",
CFP33(D3/0x402DC) = "0" and SDRENA(D7/0x39FFC1) = "0"
SDA10:
SDRAM address bus bit 10 when SDRENA(D7/0x39FFC1) = "1"
P34
#BUSREQ
#CE6
16
I/O
–
P34:
I/O port when CFP34(D4/0x402DC) = "0" (default)
#BUSREQ:
Bus release request input when CFP34(D4/0x402DC) = "1"
#CE6:
Area 6 chip enable when CFP34(D4/0x402DC) = "1" and
IOC34(D4/0x402DE) = "1"
P35
#BUSACK
15
I/O
–
P35:
I/O port when CFP35(D5/0x402DC) = "0" (default)
#BUSACK:
Bus acknowledge output when CFP35(D5/0x402DC) = "1" and
CFP34(D4/0x402DC) = "1"
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